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Datasheet > 逻辑 > 触发器/锁存器> SY100E131JC
SY100E131JC PDF预览

SY100E131JC

更新时间： 2024-11-22 22:42:35
品牌 Logo 应用领域
麦瑞 - MICREL 触发器锁存器逻辑集成电路
页数 文件大小 规格书
4页 77K
描述
4-BIT D FLIP-FLOP

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SY100E131JC 技术参数

是否Rohs认证： 不符合生命周期：Transferred
包装说明：QCCJ, LDCC28,.5SQReach Compliance Code：not_compliant
风险等级：5.73Is Samacsys：N
系列：100EJESD-30 代码：S-PQCC-J28
JESD-609代码：e0长度：11.48 mm
逻辑集成电路类型：D FLIP-FLOP最大频率@ Nom-Sup：1100000000 Hz
湿度敏感等级：1位数：2
功能数量：2端子数量：28
最高工作温度：85 °C最低工作温度：
输出特性：OPEN-EMITTER输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC28,.5SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：240
电源：-4.5 V最大电源电流（ICC）：81 mA
传播延迟（tpd）：0.675 ns认证状态：Not Qualified
座面最大高度：4.57 mm子类别：FF/Latches
表面贴装：YES技术：ECL
温度等级：COMMERCIAL EXTENDED端子面层：Tin/Lead (Sn85Pb15)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
触发器类型：POSITIVE EDGE宽度：11.48 mm
最小 fmax：1100 MHzBase Number Matches：1

SY100E131JC 数据手册

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4-BIT D  
FLIP-FLOP  
SY10E131  
SY100E131  
DESCRIPTION  
FEATURES  
■ 1100MHz min. toggle frequency  
■ Extended 100E VEE range of –4.2V to –5.5V  
■ Differential output  
The SY10/100E131 are high-speed quad master slave  
D-type flip-flops with differential outputs designed for use  
in new, high-performance ECL systems. The flip-flops may  
be individually clocked by holding CC (Common Clock) at  
a logic LOW and then using the four individual CE (Clock  
Enable CE0–CE3) inputs to accomplish such clocking.  
Alternatively, all four flip-flops can be clocked in common  
by holding the CE inputs LOW and then using CC to clock  
the data. In the common clock mode, the CE input acts as  
a control that passes the CC signal to the flip-flop. Data is  
clocked into the flip-flop on the rising edge of the output of  
the logical OR operation between CE and CC (data enters  
the master when both CC and CE are LOW and data  
transfers to the slave when either CE or CC, or both, go  
HIGH).  
■ Individual and common clocks  
■ Indivldual asynchronous reset  
■ Paired asynchronous sets  
■ Fully compatible with Industry standard 10KH,  
100K ECL levels  
■ Internal 75KΩ input pulldown resistors  
■ Fully compatible with Motorola MC10E/100E131  
■ Available in 28-pin PLCC package  
Asynchronous set and reset controls are provided. The  
reset controls are individual and the set controls are  
pairwise.  
PIN NAMES  
PIN CONFIGURATION  
Pin  
Function  
Data Inputs  
D0-D3  
CE0-CE3  
R0-R3  
CC  
Clock Enables (Individual)  
Resets  
25 24 23 22 21 20 19  
18  
26  
27  
28  
1
Q
2
CE  
3
Common Clock  
Sets (paired)  
D
3
17  
16  
15  
14  
13  
12  
Q
2
S03, S12  
Q0-Q3  
Q0-Q3  
VCCO  
S
12  
EE  
V
CC  
1
PLCC  
TOP VIEW  
J28-1  
True Outputs  
V
Q
Q
C
C
2
1
Inverting Outputs  
VCC to Output  
Q
0
S
03  
3
4
D
0
Q
0
5
6
7
8
9
10 11  
Rev.: E  
Amendment: /0  
Issue Date: November, 1998  
1
1234

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