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ICS86004BG-01 PDF预览

ICS86004BG-01

更新时间： 2024-11-09 21:17:39
品牌 Logo 应用领域
艾迪悌 - IDT 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
13页 2181K
描述
PLL Based Clock Driver, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40 X 5 MM, 0.92 MM HEIGHT, MO-153, TSSOP-16

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ICS86004BG-01 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP,针数：16
Reach Compliance Code：not_compliantHTS代码：8542.39.00.01
风险等级：5.55其他特性：ALSO OPERATES WITH 3.3V SUPPLY
输入调节：STANDARDJESD-30 代码：R-PDSO-G16
JESD-609代码：e0长度：5 mm
逻辑集成电路类型：PLL BASED CLOCK DRIVER功能数量：1
反相输出次数：端子数量：16
实输出次数：4最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：NOT SPECIFIED
传播延迟（tpd）：6.5 ns认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.55 ns座面最大高度：1.2 mm
最大供电电压 (Vsup)：2.625 V最小供电电压 (Vsup)：2.375 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mm最小 fmax：125 MHz
Base Number Matches：1

ICS86004BG-01 数据手册

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62.5MHZ TO 250MHZ, 1:4 LVCMOS/  
LVTTL ZERO DELAY CLOCK BUFFER  
ICS86004-01  
FEATURES  
GENERAL DESCRIPTION  
• Four LVCMOS/LVTTL outputs, 7Ω typical output impedance  
• Single LVCMOS/LVTTL clock input  
The ICS86004-01 is a high performance 1-to-4  
ICS  
HiPerClockS™  
LVCMOS/LVTTL Clock Buffer and a member of  
the HiPerClockS™ family of High Performance  
Clock Solutions from IDT. The ICS86004-01 has a  
fully integrated PLL and can be configured as zero  
• CLK accepts the following input levels: LVCMOS or LVTTL  
• Output frequency range: 62.5MHz to 250MHz  
• Input frequency range: 62.5MHz to 250MHz  
delay buffer and has an input and output frequency range of  
62.5MHz to 250MHz. The external feedback allows the  
device to achieve “zero delay” between the input clock and the  
output clocks. The PLL_SEL pin can be used to bypass the  
PLL for system test and debug purposes. In bypass mode, the  
reference clock is routed around the PLL and into the  
internal output divider.  
• External feedback for “zero delay” clock regeneration  
with configurable frequencies  
• Fully integrated PLL  
• Cycle-to-cycle jitter, (F_SEL = 1): 45ps (maximum)  
• Output skew: 60ps (maximum)  
• Supply Voltage Modes:  
(Core/Output)  
3.3V/3.3V  
3.3V/2.5V  
2.5V/2.5V  
• 5V tolerant input  
• -40°C to 70°C ambient operating temperature  
• Available in both standard and lead-free RoHS compliant  
packages  
CONTROL INPUT FUNCTION TABLE  
Input/Output  
Input  
Frequency Range (MHz)  
F_SEL  
Minimum  
125  
Maximum  
250  
0
1
62.5  
125  
BLOCK DIAGRAM  
PIN ASSIGNMENT  
PLL_SEL  
1
2
3
4
5
6
7
8
Q1  
GND  
Q0  
F_SEL  
VDD  
CLK  
GND  
VDDA  
16  
15  
14  
13  
12  
11  
10  
9
VDDO  
Q2  
GND  
Q3  
VDDO  
MR  
FB_IN  
PLL_SEL  
Q0  
Q1  
Q2  
Q3  
÷8  
0
1
CLK  
PLL  
1:1  
FB_IN  
ICS86004-01  
16-Lead TSSOP  
4.4mm x 5.0mm x 0.92mm package body  
G Package  
Top View  
MR  
F_SEL  
IDT™ / ICS™ LVCMOS ZERO DELAY CLOCK BUFFER  
1
ICS86004-01 REV B JUNE 21, 2006  
1234567...13

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与ICS86004BG-01相关器件

型号 品牌 获取价格 描述 数据表
ICS86004BG-01LF IDT

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 		PLL Based Clock Driver, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40 X 5 MM, 0.92
ICS86004BG-01LFT IDT

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 		PLL Based Clock Driver, 86004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40
ICS86004BGLFT IDT

获取价格

 		PLL Based Clock Driver, 86004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40
ICS86004BGT IDT

获取价格

 		PLL Based Clock Driver, 86004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40
ICS86004G-01 IDT

获取价格

 		PLL Based Clock Driver, 86004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40
ICS86004G-01LF IDT

获取价格

 		PLL Based Clock Driver, 86004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40
ICS86004G-01LFT IDT

获取价格

 		暂无描述
ICS86004G-01T IDT

获取价格

 		PLL Based Clock Driver, 86004 Series, 4 True Output(s), 0 Inverted Output(s), PDSO16, 4.40
ICS8602 ICSI

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 		ZERO DELAY, DIFFERENTIAL-TO-LVCMOS/LVTTL
ICS8602AYLF IDT

获取价格

 		Low Skew Clock Driver, 9 True Output(s), 0 Inverted Output(s), CMOS, PQFP32, 7 X 7 MM, 1.4

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