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CDCM6208V2GRGZR

更新时间: 2024-11-19 11:12:55
品牌 Logo 应用领域
德州仪器 - TI 时钟外围集成电路晶体时钟发生器
页数 文件大小 规格书
89页 3418K
描述
2:8 超低功耗、低抖动时钟发生器,引脚模式型号 V2G | RGZ | 48 | -40 to 85

CDCM6208V2GRGZR 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Active包装说明:HVQCCN,
Reach Compliance Code:compliantECCN代码:EAR99
Factory Lead Time:6 weeks风险等级:1.75
其他特性:IT ALSO OPERATES AT 2.5V AND 3.3V NOM SUPPLYJESD-30 代码:S-PQCC-N48
JESD-609代码:e4长度:7 mm
湿度敏感等级:3端子数量:48
最高工作温度:85 °C最低工作温度:-40 °C
最大输出时钟频率:800 MHz封装主体材料:PLASTIC/EPOXY
封装代码:HVQCCN封装形状:SQUARE
封装形式:CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE主时钟/晶体标称频率:50 MHz
座面最大高度:1 mm最大供电电压:3.465 V
最小供电电压:1.71 V标称供电电压:1.8 V
表面贴装:YES技术:CMOS
温度等级:INDUSTRIAL端子面层:Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式:NO LEAD端子节距:0.5 mm
端子位置:QUAD宽度:7 mm
uPs/uCs/外围集成电路类型:CLOCK GENERATOR, OTHERBase Number Matches:1

CDCM6208V2GRGZR 数据手册

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CDCM6208V2G  
ZHCSF03 MARCH 2016  
CDCM6208V2G 具有小数分频器的 2:8 时钟发生器/抖动消除器  
1 特性  
2 应用  
1
低功耗出色性能:  
基带时钟(无线基础设施)  
网络和数据通信  
低噪声合成器(265 fs-ms 典型抖动)或者低噪  
声抖动清除器(1.6 ps-ms 典型抖动)  
Keystone C66x 多核数字信号处理器 (DSP) 时钟  
存储服务器、便携式测试设备、  
医疗成像、高端 A/V  
0.5W 典型功耗  
高度通道到通道隔离和出色电源抑制比 (PSRR)  
通过灵活的 1.8V2.5V 3.3V 电源,可定制  
器件性能,从而实现混合输出电压  
3 说明  
灵活的频率规划:  
CDCM6208V2G 是一款多用途、低抖动低功耗频率合  
成器,此频率合成器能够利用特有低频晶振或 CML、  
LVPECLLVDS LVCMOS 信号的两路输入之一来  
生成八路低抖动时钟输出(输出可在类似于 LVPECL  
的高摆幅 CML、正常摆幅 CML、类似于 LVDS 的低  
功耗 CMLHCSL LVCMOS 中进行选择),广泛  
适用于各类无线基础设施基带、有线数据通信、计算、  
低功耗医疗成像以及便携式测试和测量应用。 应用。  
另外,CDCM6208V2G 还 特有 一种用于其中四路输  
出的创新型小数分频器架构,能够生成精度高于 1ppm  
的任意频率。CDCM6208V2G 可通过 I2C 或串行外设  
接口 (SPI) 编程接口轻松配置。在没有串行接口的情况  
下,器件还可以利用自身提供的引脚模式通过控制引脚  
设置为 32 种不同预编程配置中的一种。  
支持与低压正射极耦合逻辑 (LVPECL) 相似  
的、CML、或者与低压差分信号 (LVDS) 相似的  
信令的 4x 整数向下分频差分时钟输出  
支持主机时钟信号电平 (HCSL),与 LVDS 相似  
的信令、或者 8 CMOS 输出的 4x 小数或者  
整数分频差分时钟输出  
小数输出分频器可实现 0ppm <1ppm 的频率  
误差并且免除了对于晶体振荡器和其它是时钟生  
成器的需要  
输出频率高达 800MHz  
两个差分输入、XTAL 支持、智能开关功能  
SPII2C™,和引脚可编程  
用于快速设计周转时间的专业用户图形用户界面  
(GUI)  
7 x 7mm 48 引脚四方扁平无引线 (QFN) 封装  
(RGZ)  
器件信息(1)  
器件型号  
封装  
封装尺寸(标称值)  
-40 °C 85 °C 温度范围  
CDCM6208V2G  
VQFN (48)  
7.00mm x 7.00mm  
(1) 如需了解所有可用封装,请见数据表末尾的可订购产品附录。  
4 简化电路原理图  
Timing  
FBADC  
RXADC  
Core  
SyncE  
TXDAC  
DR  
Packet PCIe  
Accel  
Packet  
1pps  
GPS receiver  
network  
RF LO  
CDCM6208  
DPLL  
APLL  
IEEE1588  
timing extract  
1pps  
RF LO  
CDCM6208  
Synthesizer  
Mode  
Ethernet  
TMS320TCI6616/18  
DSP  
Pico Cell Clocking  
AIF  
ALT  
SRIO  
CORE  
Base Band DSP  
Clocking  
1
An IMPORTANT NOTICE at the end of this data sheet addresses availability, warranty, changes, use in safety-critical applications,  
intellectual property matters and other important disclaimers. PRODUCTION DATA.  
English Data Sheet: SNAS682  
 
 
 
 

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