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WED2ZL64512S42BC

更新时间： 2024-01-09 05:36:52
品牌 Logo 应用领域
WEDC 存储内存集成电路静态存储器
页数 文件大小 规格书
9页 471K
描述
512K x 64 Synchronous Pipeline NBL SRAM

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WED2ZL64512S42BC 技术参数

是否Rohs认证：不符合生命周期：Obsolete
包装说明：PLASTIC, BGA-119Reach Compliance Code：unknown
风险等级：5.92Is Samacsys：N
最长访问时间：4.2 ns其他特性：PIPELINED ARCHITECTURE
JESD-30 代码：R-PBGA-B119长度：23 mm
内存密度：33554432 bit内存集成电路类型：SRAM MODULE
内存宽度：64功能数量：1
端子数量：119字数：524288 words
字数代码：512000工作模式：SYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：512KX64封装主体材料：PLASTIC/EPOXY
封装代码：BGA封装形状：RECTANGULAR
封装形式：GRID ARRAY并行/串行：PARALLEL
峰值回流温度（摄氏度）：NOT SPECIFIED认证状态：Not Qualified
座面最大高度：1.9 mm最大供电电压 (Vsup)：2.625 V
最小供电电压 (Vsup)：2.375 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子形式：BALL
端子节距：1.27 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：17 mm
Base Number Matches：1

WED2ZL64512S42BC 数据手册

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WED2ZL64512S  
White Electronic Designs  
512K x 64 Synchronous Pipeline NBL SRAM  
FEATURES  
DESCRIPTION  
Fast clock speed: 166, 150, 133, and 100MHz  
The WEDC SyncBurst - SRAM family employs high-  
speed, low-power CMOS designs that are fabricated  
using an advanced CMOS process. WEDC’s 32Mb Sync  
SRAM integrate two 512K x 32 SRAMs into a single  
BGA package to provide 512K x 64 configuration. All  
synchronous inputs pass through registers controlled by  
a positive-edge-triggered single-clock input (CK). The  
NBLor No Bus Latency Memory utilizes all the bandwidth  
in any combination of operating cycles. Address, data  
inputs, and all control signals except output enable are  
synchronized to input clock. Output Enable controls the  
outputs at any given time and to Asynchronous Input.  
Write cycles are internally self-timed and initiated by the  
rising edge of the clock input. This feature eliminates  
complex off-chip write pulse generation and provides  
increased timing flexibility for incoming signals.  
Fast access times: 3.5ns, 3.8ns, 4.2ns, and 5.0ns  
Fast OE# access times: 3.5ns, 3.8ns, 4.2ns, and  
5.0ns  
Seperate +2.5V ± 5% power supplys for core I/O  
(VCC + VCCQ  
)
Double Word Write Control  
Clock-controlled and registered addresses, data I/Os  
and control signals  
Packaging:  
• 119 bump BGA package  
Low capacitive bus loading  
NOTE: NBL = No Bus Latency is equivalent to the industry ZBT™ devices.  
FIG. 1 PIN CONFIGURATION  
(TOP VIEW)  
BLOCK DIAGRAM  
1
2
3
4
5
6
7
8
9
SA  
0
0
–
–
–
18  
DQ  
31  
63  
DQF DQF DQF DQF NC DQG DQG DQG DQG  
DQF DQF DQF DQF NC DQG DQG DQG DQG  
DQE DQE DQE DQE NC DQH DQH DQH DQH  
DQE DQE DQE DQE NC DQH DQH DQH DQH  
DQ 32  
A
B
C
D
E
F
A0 – A18  
OE  
B
OE#  
WE#  
CK  
WEB_LW  
CK  
CS2B  
CS  
CS  
CS  
2
2
1
#
U1  
CS  
2
NC  
NC  
NC VCCQ VCCQ VCCQ NC  
NC  
NC  
DQ 0 – 31  
CS1B  
#
SA VCCQ VCC  
VCC  
VSS  
VCC  
VSS  
VCC  
VSS  
VSS  
NC  
VCC VCCQ SA  
SA  
SA  
CE# VSS  
NC  
VSS  
VSS  
NC  
VSS  
VSS  
SA  
SA  
SA  
SA  
G
H
J
512K x 36  
VSS WE1# VSS  
SA18 CE2# SSCK OE# NC  
SA1 SA0  
A0 – A18  
SA  
SA  
CE2 VSS WE0# VSS  
VSS  
VSS  
VCC  
SA  
SA  
SA  
SA  
K
L
OE#  
WE#  
CK  
WEB_HW  
NC  
VSS  
VSS  
VCC  
VSS  
VCC  
U2  
CS  
CS  
CS  
2
2
1
#
SA VCCQ VCC  
NC NC  
VCC VCCQ SA  
NC NC  
M
N
P
R
T
DQ 0 – 31  
#
NC VCCQ VCCQ VCCQ NC  
DQD DQD DQD DQD NC DQA DQA DQA DQA  
DQD DQD DQD DQD NC DQA DQA DQA DQA  
DQC DQC DQC DQC NC DQB DQB DQB DQB  
DQC DQC DQC DQC NC DQB DQB DQB DQB  
512K x 36  
U
White Electronic Designs Corp. reserves the right to change products or specifications without notice.  
October 2001  
Rev. 0  
1
White Electronic Designs Corporation • (602) 437-1520 • www.wedc.com  
1234567...9

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与WED2ZL64512S42BC相关器件

型号 品牌 获取价格 描述 数据表
WED2ZL64512S50BC WEDC

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 		512K x 64 Synchronous Pipeline NBL SRAM
WED2ZL64512S-BC ETC

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 		NBL SSRAM MCP
WED2ZLRSP01S WEDC

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 		512K x 32/256K x 32 Dual Array Synchronous Pipeline Burst NBL SRAM
WED2ZLRSP01S35BC WEDC

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