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Datasheet > 逻辑 > 时钟驱动器> PI6C2510-133ELE
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PI6C2510-133ELE

更新时间： 2024-11-19 06:03:11
品牌 Logo 应用领域
百利通 - PERICOM 时钟驱动器
页数 文件大小 规格书
4页 332K
描述
Low-Noise, Phase-Locked Loop Clock Driver with 10 Clock Outputs

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PI6C2510-133ELE 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP, TSSOP24,.25针数：24
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.29
系列：6C输入调节：STANDARD
JESD-30 代码：R-PDSO-G24JESD-609代码：e3
长度：7.8 mm逻辑集成电路类型：PLL BASED CLOCK DRIVER
湿度敏感等级：1功能数量：1
反相输出次数：端子数量：24
实输出次数：10最高工作温度：85 °C
最低工作温度：输出特性：SERIES-RESISTOR
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP24,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：3.3 V认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.15 ns座面最大高度：1.2 mm
子类别：Clock Drivers最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：OTHER端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：4.4 mmBase Number Matches：1

PI6C2510-133ELE 数据手册

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PI6C2510-133E  
Low-Noise, Phase-Locked Loop  
Clock Driver with 10 Clock Outputs  
Features  
Description  
• Operating Frequency up to 150 MHz  
The PI6C2510-133E is a “enhanced,” low-skew, low-jitter,  
phase-locked loop (PLL) clock driver, distributing high-  
frequency clock signals for SDRAM and server applications. By  
connecting the feedback FB_OUT output to the feedback FB_IN  
input, the propagation delay from the CLK_IN input to any  
clock output will be nearly zero. This zero-delay feature allows  
the CLK_IN input clock to be distributed, providing one clock  
input to one bank of ten outputs, with an output enable.  
• Low-Noise Phase-Locked Loop Clock Distribution that  
meets 133 MHz Registered DIMM Synchronous DRAM mod-  
ules for server/workstation/PC applications  
• Allows Clock Input to have Spread Spectrum modulation  
for EMI reduction  
• Low jitter: Cycle-to-Cycle jitter ±75ps max.  
• On-chip series damping resistor at clock output drivers  
for low noise and EMI reduction  
This clock driver is designed to meet the PC133 SDRAM  
Registered DIMM specification. For test purposes, the PLL can  
be bypassed by strapping AVCC to ground.  
• Operates at 3.3V VCC, 0–85°C  
• Packages (Pb-free & Green available):  
– Plastic 24-pin TSSOP (L)  
Block Diagram  
Pin Configuration  
G
AGND  
24 CLK_IN  
1
2
3
4
5
6
7
8
10  
V
23 AV  
CC  
Y0  
Y1  
CC  
Y[0:9]  
22  
V
CC  
21 Y9  
20 Y8  
19 GND  
18 GND  
17 Y7  
16 Y6  
15 Y5  
Y2  
CLK_IN  
24-Pin  
L
FB_OUT  
GND  
GND  
Y3  
PLL  
FB_IN  
Y4  
CC  
9
V
10  
11  
12  
AVcc  
G
14  
13 FB_IN  
V
CC  
FB_OUT  
Functional Table  
Inputs  
Outputs  
G
L
Y[0:9]  
L
FB_OUT  
CLK_IN  
CLK_IN  
H
CLK_IN  
PS8505B  
08/30/07  
07-0199  
1
1234

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PI6C2510-133ELE 替代型号

型号 品牌 替代类型 描述 数据表
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 适用于 DRAM 应用且具有 10 个输出的 3.3V 锁相环路时钟驱动器 | PW |
CDCVF2510APW TI

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CDCVF2510PW TI

类似代替

 3.3-V PHASE-LOCK LOOP CLOCK DRIVER

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型号 品牌 获取价格 描述 数据表
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