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74LVC74ADB,112

更新时间： 2024-11-19 15:31:27

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恩智浦 - NXP		光电二极管逻辑集成电路触发器
页数	文件大小	规格书
19页	139K
描述
74LVC74A - Dual D-type flip-flop with set and reset; positive-edge trigger SSOP1 14-Pin

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74LVC74ADB,112 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
零件包装代码：	SSOP1	包装说明：	5.30 MM, PLASTIC, MO-150, SOT337-1, SSOP-14
针数：	14	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.18
系列：	LVC/LCX/Z	JESD-30 代码：	R-PDSO-G14
JESD-609代码：	e4	长度：	6.2 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	D FLIP-FLOP
最大频率@ Nom-Sup：	120000000 Hz	最大I（ol）：	0.024 A
湿度敏感等级：	1	位数：	1
功能数量：	2	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装等效代码：	SSOP14,.3
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
包装方法：	TUBE	峰值回流温度（摄氏度）：	260
电源：	3.3 V	Prop。Delay @ Nom-Sup：	6.5 ns
传播延迟（tpd）：	7.5 ns	认证状态：	Not Qualified
座面最大高度：	2 mm	子类别：	FF/Latches
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	1.2 V
标称供电电压 (Vsup)：	2.7 V	表面贴装：	YES
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	NICKEL PALLADIUM GOLD	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	触发器类型：	POSITIVE EDGE
宽度：	5.3 mm	最小 fmax：	120 MHz
Base Number Matches：	1

74LVC74ADB,112 数据手册

74LVC74A

Dual D-type flip-flop with set and reset; positive-edge trigger

Rev. 7 — 20 November 2012

Product data sheet

1. General description

The 74LVC74A is a dual edge triggered D-type flip-flop with individual data (nD) inputs,

clock (nCP) inputs, set (nSD) and (nRD) inputs, and complementary nQ and nQ outputs.

The set and reset are asynchronous active LOW inputs and operate independently of the

clock input. Information on the data input is transferred to the nQ output on the

LOW-to-HIGH transition of the clock pulse. The nD inputs must be stable one set-up time

prior to the LOW-to-HIGH clock transition, for predictable operation.

Schmitt trigger action at all inputs makes the circuit highly tolerant of slower input rise and

fall times.

2. Features and benefits

 5 V tolerant inputs for interlacing with 5 V logic

 Wide supply voltage range from 1.2 V to 3.6 V

 CMOS low power consumption

 Direct interface with TTL levels

 Complies with JEDEC standard:

 JESD8-7A (1.65 V to 1.95 V)

 JESD8-5A (2.3 V to 2.7 V)

 JESD8-C/JESD36 (2.7 V to 3.6 V)

 ESD protection:

 HBM JESD22-A114F exceeds 2000 V

 MM JESD22-A115-B exceeds 200 V

 CDM JESD22-C101E exceeds 1000 V

 Specified from 40 C to +85 C and 40 C to +125 C

12 3 4 5 6 7...19

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型号	品牌	替代类型	描述	数据表
74LVC74ADB	NXP	类似代替	Dual D-type flip-flop with set and reset; positive-edge trigger

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74LVC74ADB-T	ETC	获取价格	Dual D-Type Flip-Flop
74LVC74AD-Q100	NEXPERIA	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74LVC74AD-Q100J	NXP	获取价格	74LVC74A-Q100 - Dual D-type flip-flop with set and reset; positive-edge trigger SOIC 14-Pi
74LVC74AD-T	NXP	获取价格	IC LVC/LCX/Z SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO1
74LVC74APW	NXP	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74LVC74APW	NEXPERIA	获取价格	Dual D-type flip-flop with set and reset; positive-edge triggerProduction
74LVC74APW,112	NXP	获取价格	74LVC74A - Dual D-type flip-flop with set and reset; positive-edge trigger TSSOP 14-Pin
74LVC74APW,118	NXP	获取价格	74LVC74A - Dual D-type flip-flop with set and reset; positive-edge trigger TSSOP 14-Pin
74LVC74APW/DG,118	NXP	获取价格	IC IC,FLIP-FLOP,DUAL,D TYPE,LCX/LVC-CMOS,TSSOP,14PIN,PLASTIC, FF/Latch
74LVC74APWDH	NXP	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger

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