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74LVC74APW/DG,118

更新时间： 2024-11-19 19:44:11

品牌	Logo	应用领域
恩智浦 - NXP		光电二极管逻辑集成电路触发器
页数	文件大小	规格书
16页	103K
描述
IC IC,FLIP-FLOP,DUAL,D TYPE,LCX/LVC-CMOS,TSSOP,14PIN,PLASTIC, FF/Latch

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74LVC74APW/DG,118 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	包装说明：	TSSOP, TSSOP14,.25
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.84	JESD-30 代码：	R-PDSO-G14
JESD-609代码：	e3	负载电容（CL）：	50 pF
逻辑集成电路类型：	JBAR-KBAR FLIP-FLOP	最大频率@ Nom-Sup：	120000000 Hz
最大I（ol）：	0.024 A	湿度敏感等级：	1
功能数量：	2	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP14,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	包装方法：	TAPE AND REEL
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	3.3 V
Prop。Delay @ Nom-Sup：	6.5 ns	认证状态：	Not Qualified
子类别：	FF/Latches	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
触发器类型：	POSITIVE EDGE	Base Number Matches：	1

74LVC74APW/DG,118 数据手册

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74LVC74A

Dual D-type ﬂip-ﬂop with set and reset; positive-edge trigger

Rev. 06 — 4 June 2007

Product data sheet

1. General description

The 74LVC74A is a dual edge triggered D-type ﬂip-ﬂop with individual data (D) inputs,

clock (CP) inputs, set (SD) and (RD) inputs, and complementary Q and Q outputs.

The set and reset are asynchronous active LOW inputs and operate independently of the

clock input. Information on the data input is transferred to the Q output on the

LOW-to-HIGH transition of the clock pulse. The D inputs must be stable one set-up time

prior to the LOW-to-HIGH clock transition, for predictable operation.

Schmitt trigger action at all inputs makes the circuit highly tolerant of slower input rise and

fall times.

2. Features

I 5 V tolerant inputs for interlacing with 5 V logic

I Wide supply voltage range from 1.2 V to 3.6 V

I CMOS low power consumption

I Direct interface with TTL levels

I Complies with JEDEC standard JESD8-B/JESD36

I ESD protection:

N HBM JESD22-A114D exceeds 2000 V

N CDM JESD22-C101C exceeds 1000 V

I Speciﬁed from −40 °C to +85 °C and −40 °C to 125 °C

3. Ordering information

Table 1.

Type number Package

Temperature range Name

Ordering information

Description

Version

74LVC74AD

−40 °C to +125 °C

SO14

plastic small outline package; 14 leads;

body width 3.9 mm

SOT108-1

74LVC74ADB −40 °C to +125 °C

74LVC74APW −40 °C to +125 °C

74LVC74ABQ −40 °C to +125 °C

SSOP14

TSSOP14

plastic shrink small outline package; 14 leads;

body width 5.3 mm

SOT337-1

SOT402-1

plastic thin shrink small outline package; 14 leads;

body width 4.4 mm

DHVQFN14 plastic dual in-line compatible thermal enhanced very thin SOT762-1

quad ﬂat package; no leads; 14 terminals;

body 2.5 × 3 × 0.85 mm

12 3 4 5 6 7...16

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型号	品牌	获取价格	描述	数据表
74LVC74APWDH	NXP	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74LVC74APW-Q100	NXP	获取价格	LVC/LCX/Z SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14,
74LVC74APW-Q100	NEXPERIA	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74LVC74APW-Q100J	NXP	获取价格	74LVC74A-Q100 - Dual D-type flip-flop with set and reset; positive-edge trigger TSSOP 14-P
74LVC74APW-T	NXP	获取价格	IC LVC/LCX/Z SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO1
74LVC74A-Q100	NEXPERIA	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74LVC74D	NXP	获取价格	暂无描述
74LVC74DB	PHILIPS	获取价格	D Flip-Flop, 2-Func, Positive Edge Triggered, CMOS, PDSO14,
74LVC74DB	NXP	获取价格	IC LVC/LCX/Z SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO1
74LVC74DB-T	NXP	获取价格	IC LVC/LCX/Z SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO1

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