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Datasheet > 存储 > SRAM> CY7C135-25JXC
CY7C135-25JXC PDF预览

CY7C135-25JXC

更新时间： 2024-09-16 05:09:35
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 存储内存集成电路静态存储器
页数 文件大小 规格书
12页 402K
描述
4K x 8 Dual-Port Static RAM and 4K x 8 Dual-Port SRAM with Semaphores

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CY7C135-25JXC 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：LCC包装说明：LEAD FREE, PLASTIC, LCC-52
针数：52Reach Compliance Code：unknown
ECCN代码：EAR99HTS代码：8542.32.00.41
风险等级：5.74Is Samacsys：N
最长访问时间：25 nsI/O 类型：COMMON
JESD-30 代码：S-PQCC-J52JESD-609代码：e3
长度：19.1262 mm内存密度：32768 bit
内存集成电路类型：DUAL-PORT SRAM内存宽度：8
湿度敏感等级：3功能数量：1
端口数量：2端子数量：52
字数：4096 words字数代码：4000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：4KX8
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装等效代码：LDCC52,.8SQ
封装形状：SQUARE封装形式：CHIP CARRIER
并行/串行：PARALLEL峰值回流温度（摄氏度）：260
电源：5 V认证状态：Not Qualified
座面最大高度：5.08 mm最大待机电流：0.015 A
最小待机电流：4.5 V子类别：SRAMs
最大压摆率：0.18 mA最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：20
宽度：19.1262 mmBase Number Matches：1

CY7C135-25JXC 数据手册

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CY7C135  
CY7C1342  
4K x 8 Dual-Port Static RAM and 4K x 8  
Dual-Port SRAM with Semaphores  
Functional Description  
Features  
• True Dual-Ported memory cells which allow simulta-  
neous reads of the same memory location  
The CY7C135 and CY7C1342 are high-speed CMOS 4K x 8  
dual-port static RAMs. The CY7C1342 includes semaphores  
that provide a means to allocate portions of the dual-port RAM  
or any shared resource. Two ports are provided permitting  
independent, asynchronous access for reads and writes to  
any location in memory. Application areas include interpro-  
cessor/multiprocessor designs, communications status  
buffering, and dual-port video/graphics memory.  
• 4K x 8 organization  
• 0.65-micron CMOS for optimum speed/power  
• High-speed access: 15 ns  
• Low operating power: ICC = 160 mA (max.)  
• Fully asynchronous operation  
• Automatic power-down  
Each port has independent control pins: chip enable (CE),  
read or write enable (R/W), and output enable (OE). The  
CY7C135 is suited for those systems that do not require  
on-chip arbitration or are intolerant of wait states. Therefore,  
the user must be aware that simultaneous access to a location  
is possible. Semaphores are offered on the CY7C1342 to  
assist in arbitrating between ports. The semaphore logic is  
comprised of eight shared latches. Only one side can control  
the latch (semaphore) at any time. Control of a semaphore  
indicates that a shared resource is in use. An automatic  
power-down feature is controlled independently on each port  
by a chip enable (CE) pin or SEM pin (CY7C1342 only).  
• Semaphoresincludedonthe7C1342topermitsoftware  
handshaking between ports  
• Available in 52-pin PLCC  
• Pb-Free packages available  
The CY7C135 and CY7C1342 are available in 52-pin PLCC.  
Logic Block Diagram  
R/W  
L
R/W  
R
CE  
OE  
CE  
R
L
OE  
R
L
I/O  
I/O  
7L  
7R  
0R  
I/O  
CONTROL  
I/O  
CONTROL  
I/O  
0L  
I/O  
A
A
11L  
0L  
11R  
0R  
ADDRESS  
DECODER  
ADDRESS  
DECODER  
MEMORY  
ARRAY  
A
A
SEMAPHORE  
ARBITRATION  
(7C1342 only)  
CE  
L
CE  
R
OE  
L
OE  
R
R/W  
R/W  
R
L
(7C1342 only)  
(7C1342 only)  
SEM  
SEM  
R
L
Cypress Semiconductor Corporation  
Document #: 38-06038 Rev. *C  
•
198 Champion Court  
•
San Jose, CA 95134-1709  
•
408-943-2600  
Revised September 6, 2005  
1234567...12

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型号 品牌 获取价格 描述 数据表
CY7C1352-80AC CYPRESS

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 		暂无描述
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