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SI53019-A02AGMR

更新时间： 2024-09-16 15:51:11

品牌	Logo	应用领域
芯科 - SILICON		驱动逻辑集成电路
页数	文件大小	规格书
37页	675K
描述
PLL Based Clock Driver, 53019 Series, 38 True Output(s), 0 Inverted Output(s), QFN-72

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SI53019-A02AGMR 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	HVQCCN,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.69
系列：	53019	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	S-XQCC-N72	长度：	10 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	72
实输出次数：	38	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
座面最大高度：	0.95 mm	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	10 mm
Base Number Matches：	1

SI53019-A02AGMR 数据手册

Si53019-A02A

19-OUTPUT PCI

3 AND QPI BUFFER

Features

 Nineteen 0.7 V current-mode,

HCSL PCIe Gen3 outputs

 100 MHz /133 MHz PLL

operation, supports PCIe and

QPI

 PLL bandwidth SW SMBUS

programming overrides the latch

value from HW pin

 PLL or bypass mode

 Spread spectrum tolerable

 50 ps output-to-output skew

 Fixed 0 ps input to output delay

 Low phase jitter (Intel QPI, PCIe

Gen 1/2/3/4 common clock

compliant)

 Gen 3 SRNS Compliant

 9 selectable SMBUS addresses

 Fixed internal feedback path

 8 dedicated OE pins

 100 ps input-to-output delay

Ordering Information:

 Extended Temperature:

–40 to 85 °C

See page 32.

 Package: 72-pin QFN

Applications

Pin Assignments

 Server

 Data center

 Storage

OE11

VDDA

GNDA

IREF

DIF_11

OE10

100M_133M

DIF_10

HBW_BYPASS_LBW

PWRGD / PWRDN

GND

Description

OE9

VDDR

CLK_IN

SA_0

DIF_9

Si53019-A02A

45 VDD

GND

OE8

DIF_8

OE7

The Si53019-A02A is a 19-output, current mode HCSL differential clock

buffer that meets all of the performance requirements of the Intel

DB1900Z specification. The device is optimized for distributing reference

SDA

SCL

SA_1

DIF_7

38 DIF_7

OE6

FB_OUT

clocks for Intel QuickPath Interconnect (Intel QPI), PCIe Gen 1/Gen 2/

Gen 3/Gen 4, SAS, SATA, and Intel Scalable Memory Interconnect (Intel

SMI) applications. The VCO of the device is optimized to support

100 MHz and 133 MHz operation. Each differential output can be enabled

Note: FB_OUT pins must be identically terminated to the other DIF outputs.

Patents pending

through I C for maximum flexibility and power savings.

The Si53019-A02A features a fixed internal feedback path. Measuring

PCIe clock jitter is quick and easy with the Silicon Labs PCIe Clock Jitter

Tool. Download it for free at www.silabs.com/pcie-learningcenter.

Rev. 1.2 2/16

Si53019-A02A

12 3 4 5 6 7...37

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SI53019-A02AGMR 替代型号

型号	品牌	替代类型	描述	数据表
SI53019-A02AGM	SILICON	完全替代	PLL Based Clock Driver, 53019 Series, 38 True Output(s), 0 Inverted Output(s), QFN-72

与SI53019-A02AGMR相关器件

型号	品牌	获取价格	描述	数据表
SI-53019-F	BEL	获取价格	SI-53019-F
SI-53020	BEL	获取价格	Telecom and Datacom Connector, ROHS COMPLIANT
SI-53021	BEL	获取价格	Telecom and Datacom Connector
SI-53021-F	BEL	获取价格	SI-53021-F
SI-53022	BEL	获取价格	SI-53022
SI-53023	BEL	获取价格	SI-53023
SI-53024	BEL	获取价格	SI-53024
SI-53024-F	BEL	获取价格	SI-53024-F
SI-53028-F	BEL	获取价格	SI-53028-F
SI-53030-F	BEL	获取价格	SI-53030-F

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