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RM100331WFQMLV

更新时间： 2024-11-05 19:58:35
品牌 Logo 应用领域
德州仪器 - TI 输出元件逻辑集成电路触发器
页数 文件大小 规格书
10页 189K
描述
100K SERIES, TRIPLE POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CQFP24, CERQUAD-24

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RM100331WFQMLV 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：QFF,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.92
系列：100KJESD-30 代码：S-GQFP-F24
JESD-609代码：e0逻辑集成电路类型：D FLIP-FLOP
湿度敏感等级：1位数：1
功能数量：3端子数量：24
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：COMPLEMENTARY封装主体材料：CERAMIC, GLASS-SEALED
封装代码：QFF封装形状：SQUARE
封装形式：FLATPACK传播延迟（tpd）：2 ns
认证状态：Not Qualified筛选级别：MIL-PRF-38535 Class V
座面最大高度：2.159 mm表面贴装：YES
技术：ECL温度等级：MILITARY
端子面层：Tin/Lead (Sn63Pb37)端子形式：FLAT
端子节距：1.27 mm端子位置：QUAD
触发器类型：POSITIVE EDGE最小 fmax：400 MHz
Base Number Matches：1

RM100331WFQMLV 数据手册

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August 1998  
100331  
Low Power Triple D Flip-Flop  
General Description  
Features  
n 35% power reduction of the 100131  
n 2000V ESD protection  
The 100331 contains three D-type, edge-triggered master/  
slave flip-flops with true and complement outputs, a Com-  
mon Clock (CPC), and Master Set (MS) and Master Reset  
(MR) inputs. Each flip-flop has individual Clock (CPn), Direct  
Set (SDn) and Direct Clear (CDn) inputs. Data enters a mas-  
ter when both CPn and CPC are LOW and transfers to a  
slave when CPn or CPC (or both) go HIGH. The Master Set,  
Master Reset and individual CDn and SDn inputs override  
the Clock inputs. All inputs have 50 kΩ pull-down resistors.  
n Pin/function compatible with 100131  
=
n Voltage compensated operating range −4.2V to −5.7V  
n Available to industrial grade temperature range  
n Available to Standard Microcircuit Drawing (SMD)  
5962-9153601  
Logic Symbol  
Pin Names  
CP0–CP2  
CPC  
Description  
Individual Clock Inputs  
Common Clock Input  
Data Inputs  
D0–D2  
CD0–CD2  
SDn  
Individual Direct Clear Inputs  
Individual Direct Set Inputs  
Master Reset Input  
MR  
MS  
Master Set Input  
Q0-Q2  
Q0–Q2  
Data Outputs  
Complementary Data Outputs  
DS100300-1  
Connection Diagrams  
24-Pin DIP  
24-Pin Quad Cerpak  
DS100300-3  
DS100300-2  
© 1998 National Semiconductor Corporation  
DS100300  
www.national.com  
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型号 品牌 获取价格 描述 数据表
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 		100K SERIES, 8-BIT BIDIRECTIONAL PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, CQF
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