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NB6L11SMNG

更新时间： 2024-12-01 03:20:51
品牌 Logo 应用领域
安森美 - ONSEMI 逻辑集成电路驱动
页数 文件大小 规格书
10页 107K
描述
2.5 V 1:2 AnyLevel TM Input to LVDS Fanout Buffer / Translator

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NB6L11SMNG 技术参数

是否无铅： 不含铅生命周期：Active
零件包装代码：QFN包装说明：HVQCCN, LCC16,.12SQ,20
针数：16Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：1.07
系列：6L输入调节：DIFFERENTIAL
JESD-30 代码：S-XQCC-N16长度：3 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：1
功能数量：1反相输出次数：
端子数量：16实输出次数：2
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装等效代码：LCC16,.12SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
电源：2.5 VProp。Delay @ Nom-Sup：0.45 ns
传播延迟（tpd）：0.45 ns认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.025 ns座面最大高度：1 mm
子类别：Clock Drivers最大供电电压 (Vsup)：2.625 V
最小供电电压 (Vsup)：2.375 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES温度等级：INDUSTRIAL
端子面层：Nickel/Gold/Palladium (Ni/Au/Pd)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：3 mm
Base Number Matches：1

NB6L11SMNG 数据手册

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NB6L11S  
2.5 V 1:2 AnyLevelt Input  
to LVDS Fanout Buffer /  
Translator  
The NB6L11S is a differential 1:2 Clock or Data Receiver and will  
accept AnyLevelt input signals: LVPECL, CML, LVCMOS,  
LVTTL, or LVDS. These signals will be translated to LVDS and two  
identical copies of Clock or Data will be distributed, operating up to  
2.0 GHz or 2.5 Gb/s, respectively. As such, the NB6L11S is ideal for  
SONET, GigE, Fiber Channel, Backplane and other Clock or Data  
distribution applications.  
http://onsemi.com  
MARKING  
DIAGRAM*  
16  
1
The NB6L11S has a wide input common mode range from  
NB6L  
11S  
1
GND + 50 mV to V − 50 mV. Combined with the 50 W internal  
CC  
termination resistors at the inputs, the NB6L11S is ideal for translating  
a variety of differential or single−ended Clock or Data signals to  
350 mV typical LVDS output levels.  
ALYW G  
QFN−16  
MN SUFFIX  
CASE 485G  
G
The NB6L11S is the 2.5 V version of the NB6N11S and is offered in  
a small 3 mm X 3 mm 16−QFN package. Application notes, models,  
and support documentation are available at www.onsemi.com.  
A
L
= Assembly Location  
= Wafer Lot  
Y
W
G
= Year  
= Work Week  
= Pb−Free Package  
Features  
• Maximum Input Clock Frequency > 2.0 GHz  
• Maximum Input Data Rate > 2.5 Gb/s  
• 1 ps Maximum of RMS Clock Jitter  
• Typically 10 ps of Data Dependent Jitter  
• 380 ps Typical Propagation Delay  
(Note: Microdot may be in either location)  
*For additional marking information, refer to  
Application Note AND8002/D.  
Q0  
• 120 ps Typical Rise and Fall Times  
V
V
• Single Power Supply; V = 2.5 V " 5%  
Q0  
TD  
CC  
• These are Pb−Free Devices  
D
D
TD  
Q1  
Q1  
Figure 1. Logic Diagram  
Device DDJ = 10 ps  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 9 of this data sheet.  
TIME (58 ps/div)  
Figure 2. Typical Output Waveform at 2.488 Gb/s with  
PRBS 223−1 (VINPP = 400 mV; Input Signal DDJ = 14 ps)  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
September, 2006 − Rev. 2  
NB6L11S/D  
1234567...10

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NB6L11SMNG 替代型号

型号 品牌 替代类型 描述 数据表
NB6L11SMNR2G ONSEMI

完全替代

 2.5 V 1:2 AnyLevel TM Input to LVDS Fanout Buffer / Translator
NB6L11MMNR2G ONSEMI

类似代替

 2.5V / 3.3V 1:2 Differential CML Fanout Buffer
NB6L11MMNG ONSEMI

类似代替

 2.5V / 3.3V 1:2 Differential CML Fanout Buffer

与NB6L11SMNG相关器件

型号 品牌 获取价格 描述 数据表
NB6L11SMNR2G ONSEMI

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 		2.5 V 1:2 AnyLevel TM Input to LVDS Fanout Buffer / Translator
NB6L14 ONSEMI

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 		2.5 V/3.3 V 3.0 GHz Differential 1:4 LVPECL Fanout Buffer
NB6L14_07 ONSEMI

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NB6L14S ONSEMI

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 		2.5 V 1:4 AnyLevel™ Differential Input to LVD
NB6L14S_11 ONSEMI

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 		Differential Input to LVDS Fanout Buffer/Translator

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