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NB6L16DTR2G PDF预览

NB6L16DTR2G

更新时间： 2024-12-01 03:46:59
品牌 Logo 应用领域
安森美 - ONSEMI 时钟驱动器转换器逻辑集成电路光电二极管
页数 文件大小 规格书
12页 188K
描述
2.5V / 3.3V Multilevel Input to Differential LVPECL/LVNECL Clock or Data Receiver/ Driver/Translator Buffer

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NB6L16DTR2G 技术参数

是否无铅：不含铅生命周期：Lifetime Buy
零件包装代码：SOIC包装说明：TSSOP,
针数：8Reach Compliance Code：compliant
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：5.39Is Samacsys：N
其他特性：NECL MODE: VCC = 0V WITH VEE = -2.375V TO -3.465V系列：6L
输入调节：DIFFERENTIALJESD-30 代码：S-PDSO-G8
JESD-609代码：e3长度：3 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：3
功能数量：1反相输出次数：
端子数量：8实输出次数：1
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：SQUARE封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260传播延迟（tpd）：0.18 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.06 ns
座面最大高度：1.1 mm最大供电电压 (Vsup)：3.465 V
最小供电电压 (Vsup)：2.375 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：ECL
温度等级：INDUSTRIAL端子面层：Tin (Sn)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：3 mmBase Number Matches：1

NB6L16DTR2G 数据手册

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NB6L16  
2.5V / 3.3V Multilevel Input to  
Differential LVPECL/LVNECL  
Clock or Data Receiver/  
Driver/Translator Buffer  
http://onsemi.com  
MARKING  
The NB6L16 is a high precision, low power ECL differential clock  
or data receiver/driver/translator buffer. The device is functionally  
equivalent to the EL16, EP16, LVEL16 and NBSG16 devices. With  
output transition times of 70 ps, it is ideally suited for high frequency,  
low power systems. The device is targeted for Backplane buffering,  
GbE clock/data distribution, Fibre Channel distribution and SONET  
clock/data distribution applications.  
Input accept LVNECL (Negative ECL), LVPECL (Positive ECL),  
LVTTL, LVCMOS, CML, or LVDS. Outputs are 800 mV  
ECL signals.  
DIAGRAMS*  
8
8
6L16  
1
ALYW  
G
SOIC−8  
D SUFFIX  
CASE 751  
1
The V pin, an internally generated voltage supply, is available to  
BB  
this device only. For single−ended input conditions, the unused  
8
8
differential input is connected to V as a switching reference voltage.  
BB  
1
6L16  
V
BB  
may also rebias AC coupled inputs. When used, decouple V  
BB  
ALYWG  
TSSOP−8  
DT SUFFIX  
CASE 948R  
and V via a 0.01 mF capacitor and limit current sourcing or sinking  
CC  
G
to 0.5 mA. When not used, V should be left open.  
BB  
1
Features  
A
L
Y
W
G
= Assembly Location  
= Wafer Lot  
= Year  
= Work Week  
= Pb−Free Package  
• Maximum Input Clock Frequency w 6 GHz Typical  
• Maximum Input Data Rate Frequency w 6 Gb/s Typical  
• Low 12 mA Typical Power Supply Current  
• 70 ps Typical Rise/Fall Times  
(Note: Microdot may be in either location)  
• 130 ps Input Propagation Delay  
*For additional marking information, refer to  
Application Note AND8002/D.  
• On−Chip Reference for ECL Single−Ended Input − V Output  
BB  
• PECL Mode Operating Range:  
V
CC  
= 2.375 V to 3.465 V with V = 0 V  
EE  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 10 of this data sheet.  
• NECL Mode Operating Range:  
= 0 V with V = −2.375 V to −3.465 V  
V
CC  
EE  
• Open Input Default State  
• LVDS, LVPECL, LVNECL, LVCMOS, LVTTL and CML Input  
Compatible  
• Pb−Free Packages are Available  
©
Semiconductor Components Industries, LLC, 2007  
1
Publication Order Number:  
March, 2007 − Rev. 6  
NB6L16/D  
1234567...12

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NB6L16DTR2G 替代型号

型号 品牌 替代类型 描述 数据表
NB6L16DTR2 ONSEMI

完全替代

 2.5V / 3.3V Multilevel Input to Differential LVPECL/LVNECL Clock or Data Receiver/ Driver/
NB6L16DTG ONSEMI

类似代替

 2.5V / 3.3V Multilevel Input to Differential LVPECL/LVNECL Clock or Data Receiver/ Driver/

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型号 品牌 获取价格 描述 数据表
NB6L239 ONSEMI

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 		2.5 V / 3.3 V Any Differential Clock IN to Di
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