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NB3N51044DTG

更新时间： 2024-11-24 01:06:39

品牌	Logo	应用领域
安森美 - ONSEMI		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
13页	219K
描述
Quad HCSL / LVDS Clock Generator

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NB3N51044DTG 技术参数

是否无铅：	不含铅	生命周期：	Active
包装说明：	TSSOP, TSSOP28,.25	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
Factory Lead Time：	6 weeks	风险等级：	5.73
JESD-30 代码：	R-PDSO-G28	JESD-609代码：	e3
长度：	9.7 mm	湿度敏感等级：	1
端子数量：	28	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP28,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
电源：	3.3 V	主时钟/晶体标称频率：	25 MHz
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	Clock Generators	最大压摆率：	126 mA
最大供电电压：	3.465 V	最小供电电压：	3.135 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Tin (Sn)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
宽度：	4.4 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：	1

NB3N51044DTG 数据手册

NB3N51044

3.3 V, Crystal to 100 MHz /

125 MHz Quad HCSL / LVDS

Clock Generator

The NB3N51044 is a precision, low phase noise clock generator that

supports PCI Express and sRIO clock requirements. The device

accepts a 25 MHz fundamental mode parallel resonant crystal or a

25 MHz single ended reference clock signal and generates four

differential HCSL/LVDS outputs (See Figure 10 for LVDS interface)

of 100 MHz or 125 MHz clock frequency based on frequency select

input F_SEL. NB3N51044 is configurable to bypass the PLL from

signal path using BYPASS, and provides the output frequency through

the divider network. All clock outputs can be individually enabled /

disabled through hardware input pins OE[3:0]. In addition, device can

be reset using Master Reset input pin MR_OE#.

www.onsemi.com

MARKING DIAGRAM

NB3N5

1044G

ALYW

TSSOP−28

DT SUFFIX

CASE 948AA

Features

= Assembly Location

= Wafer Lot

= Year

= Work Week

= Pb−Free Package

• Uses 25 MHz Fundamental Crystal or Reference Clock Input

• Four Low Skew HCSL or LVDS Outputs

• Output Frequency Selection of 100 MHz or 125 MHz

• Individual OE Tri−States Outputs

• Master Reset and BYPASS Modes

ORDERING INFORMATION

See detailed ordering and shipping information on page 12 of

this data sheet.

• PCIe Gen 1, Gen 2, Gen 3, Gen 4 Compliant

• Typical Phase Jitter @ 125 MHz (Integrated 1.875 MHz to 20 MHz):

0.2 ps

• Typical Cycle−Cycle Jitter @ 100 MHz (10k cycles): 20 ps

• Phase Noise @ 100 MHz:

Offset

100 Hz

1 kHz

Noise Power

−101 dBc/Hz

−123 dBc/Hz

−133 dBc/Hz

10 kHz

100 kHz −136 dBc/Hz

1 MHz −141 dBc/Hz

10 MHz −155 dBc/Hz

• Operating Supply Voltage Range 3.3 V 5%

• Industrial Temperature Range −40°C to +85°C

• Functionally Compatible with ICS841604I with enhanced performance

• These are Pb−Free Devices

Applications

End Products

• Networking

• Switch and Router

• Set Top Box, LCD TV

• Servers, Desktop Computers

• Automated Test Equipment

• Consumer

• Computing and Peripherals

• Industrial Equipment

• PCIe Clock Generation Gen 1, Gen 2, Gen 3 and Gen 4

Publication Order Number:

September, 2017 − Rev. 2

NB3N51044/D

12 3 4 5 6 7...13

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NB3N51044DTG 替代型号

型号	品牌	替代类型	描述	数据表
NB3N51044DTR2G	ONSEMI	完全替代	Quad HCSL / LVDS Clock Generator
SI52112-B3-GM2	SILICON	功能相似	Processor Specific Clock Generator, 100MHz, CMOS, PDSO10, 3 X 3 MM, ROHS COMPLIANT, MO-229
SI52112-A1-GM2	SILICON	功能相似	Processor Specific Clock Generator, 100MHz, CMOS, PDSO10, 3 X 3 MM, ROHS COMPLIANT, MO-229

与NB3N51044DTG相关器件

型号	品牌	获取价格	描述	数据表
NB3N51044DTR2G	ONSEMI	获取价格	Quad HCSL / LVDS Clock Generator
NB3N51054	ONSEMI	获取价格	Quad HCSL/LVDS PCIe Clock Generator
NB3N51054_18	ONSEMI	获取价格	Quad HCSL/LVDS PCIe Clock Generator
NB3N51054DTG	ONSEMI	获取价格	Quad HCSL/LVDS PCIe Clock Generator
NB3N51054DTR2G	ONSEMI	获取价格	Quad HCSL/LVDS PCIe Clock Generator
NB3N511	ONSEMI	获取价格	3.3V / 5.0V 14 MHz to 200 MHz PLL Clock Multiplier
NB3N511_13	ONSEMI	获取价格	3.3V / 5.0V 14 MHz to 200 MHz PLL Clock Multiplier
NB3N511DG	ONSEMI	获取价格	3.3V / 5.0V 14 MHz to 200 MHz PLL Clock Multiplier
NB3N511DR2G	ONSEMI	获取价格	3.3V / 5.0V 14 MHz to 200 MHz PLL Clock Multiplier
NB3N551	ONSEMI	获取价格	3.3 V / 5.0 V Ultra-Low Skew 1:4 Clock Fanout Buffer

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