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MC74VHC04MR2 PDF预览

MC74VHC04MR2

更新时间： 2024-11-04 14:53:15
品牌 Logo 应用领域
安森美 - ONSEMI 输入元件光电二极管
页数 文件大小 规格书
6页 133K
描述
AHC/VHC SERIES, HEX 1-INPUT INVERT GATE, PDSO14, EIAJ, SOIC-14

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MC74VHC04MR2 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP,
针数：14Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.12
系列：AHC/VHCJESD-30 代码：R-PDSO-G14
JESD-609代码：e0长度：10.2 mm
逻辑集成电路类型：INVERTER功能数量：6
输入次数：1端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：225传播延迟（tpd）：12 ns
认证状态：Not Qualified座面最大高度：2.05 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：5.275 mm
Base Number Matches：1

MC74VHC04MR2 数据手册

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MC74VHC04  
Hex Inverter  
The MC74VHC04 is an advanced high speed CMOS inverter  
fabricated with silicon gate CMOS technology. It achieves high speed  
operation similar to equivalent Bipolar Schottky TTL while  
maintaining CMOS low power dissipation.  
The internal circuit is composed of three stages, including a buffer  
output which provides high noise immunity and stable output. The  
inputs tolerate voltages up to 7 V, allowing the interface of 5 V systems  
to 3 V systems.  
http://onsemi.com  
MARKING DIAGRAMS  
14  
Features  
SOIC−14  
D SUFFIX  
CASE 751A  
VHC04G  
AWLYWW  
• High Speed: t = 3.8 ns (Typ) at V = 5 V  
PD  
CC  
1
• Low Power Dissipation: I = 2 mA (Max) at T = 25°C  
CC  
A
1
• High Noise Immunity: V  
= V = 28% V  
NIL CC  
NIH  
• Power Down Protection Provided on Inputs  
• Balanced Propagation Delays  
14  
1
VHC  
04  
TSSOP−14  
DT SUFFIX  
CASE 948G  
• Designed for 2 V to 5.5 V Operating Range  
ALYWG  
G
• Low Noise: V  
= 0.8 V (Max)  
OLP  
1
• Pin and Function Compatible with Other Standard Logic Families  
• Latchup Performance Exceeds 300 mA  
14  
• ESD Performance: HBM > 2000 V; Machine Model > 200 V  
• Chip Complexity: 36 FETs or 9 Equivalent Gates  
• These Devices are Pb−Free and are RoHS Compliant  
SOEIAJ−14  
M SUFFIX  
CASE 965  
74VHC04G  
ALYWG  
1
1
A
WL, L  
Y
= Assembly Location  
= Wafer Lot  
= Year  
1
3
5
2
4
6
A1  
A2  
A3  
Y1  
Y2  
Y3  
A1  
Y1  
V
CC  
WW, W = Work Week  
G or G  
= Pb−Free Package  
A6  
(Note: Microdot may be in either location)  
A2  
Y6  
A5  
Y5  
A4  
Y4  
FUNCTION TABLE  
Y2  
Y = A  
Inputs  
A
Outputs  
Y
9
8
10  
12  
A4  
A5  
A6  
Y4  
Y5  
Y6  
A3  
L
H
L
Y3  
H
11  
13  
GND  
ORDERING INFORMATION  
†
Device  
Package  
Shipping  
Figure 2. Pinout:  
14−Lead Packages  
(Top View)  
MC74VHC04DR2G  
MC74VHC04DTR2G  
MC74VHC04MELG  
SOIC−14  
2500 / T&R  
Figure 1. Logic Diagram  
TSSOP−14 2500 / T&R  
SOEIAJ−14 2000 / T&R  
†For information on tape and reel specifications,  
including part orientation and tape sizes, please  
refer to our Tape and Reel Packaging Specification  
Brochure, BRD8011/D.  
© Semiconductor Components Industries, LLC, 2011  
1
Publication Order Number:  
June, 2011 − Rev. 5  
MC74VHC04/D  
123456

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