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Datasheet > 逻辑 > 移位寄存器> M74HC166C1R
M74HC166C1R PDF预览

M74HC166C1R

更新时间： 2024-10-31 22:57:55
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 移位寄存器触发器逻辑集成电路
页数 文件大小 规格书
13页 272K
描述
8 BIT PISO SHIFT REGISTER

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M74HC166C1R 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：QFN包装说明：CC-20
针数：20Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.84
Is Samacsys：N其他特性：CLOCK INHIBIT
计数方向：RIGHT系列：HC/UH
JESD-30 代码：S-PQCC-J20JESD-609代码：e3
长度：8.9662 mm负载电容（CL）：50 pF
逻辑集成电路类型：PARALLEL IN SERIAL OUT最大频率@ Nom-Sup：25000000 Hz
位数：8功能数量：1
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC20,.4SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/6 V传播延迟（tpd）：38 ns
认证状态：Not Qualified座面最大高度：4.57 mm
子类别：Shift Registers最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：8.9662 mm
最小 fmax：25 MHzBase Number Matches：1

M74HC166C1R 数据手册

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M54HC166  
M74HC166  
8 BIT PISO SHIFT REGISTER  
.
.
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.
.
.
.
HIGH SPEED  
fMAX = 57 MHz (TYP.) AT VCC = 5 V  
LOW POWER DISSIPATION  
ICC = 4 µA (MAX.) AT TA = 25 °C  
HIGH NOISE IMMUNITY  
VNIH = VNIL = 28 % VCC (MIN.)  
OUTPUT DRIVE CAPABILITY  
10 LSTTL LOADS  
SYMMETRICAL OUTPUT IMPEDANCE  
|IOH| = IOL = 4 mA (MIN.)  
BALANCED PROPAGATION DELAYS  
tPLH = tPHL  
WIDE OPERATING VOLTAGE RANGE  
B1R  
(Plastic Package)  
F1R  
(Ceramic Package)  
M1R  
(Micro Package)  
C1R  
(Chip Carrier)  
VCC (OPR) = 2 V TO 6 V  
PIN AND FUNCTION COMPATIBLE WITH  
54/74LS166  
ORDER CODES :  
M54HC166F1R  
M74HC166B1R  
M74HC166M1R  
M74HC166C1R  
PIN CONNECTIONS (top view)  
DESCRIPTION  
The M54/74HC166 is a high speed C2MOS 8 BIT  
PISO SHIFT REGISTER fabricated in silicon gate  
C2MOS technology. It has the same highspeed per-  
formance of LSTTL combined with true CMOS low  
power consumption.  
It consists of parallel or serial inputs and a serial-out  
8-bit shift register with gated clock inputs and an  
overriding clear input. The parallel-in or serial-in  
modes are controlled by the SHIFT/LOAD input.  
When the SHIFT/LOAD input is held high, the serial  
data input is enabled and the eight flip-flops perform  
serial shifting with each clock pulse. When held low,  
the parallel data inputs are enabled and syn-  
chronous loading occurs on the next clock pulse.  
Clocking is accomplished on the low-to-high level  
edge of the clock pulse. The CLOCK-INHIBIT input  
should be changed to the high only while the  
CLOCK input is held high. A direct clear input over-  
rides all other inputs, including the clock, and sets  
all flip-flops to zero. Functional details are shown in  
the truth table and the timing chart.  
NC =  
No Inter-  
nal Con-  
All inputs are equipped with protection circuits  
against static discharge and transient excess volt-  
age.  
October 1992  
1/13  
1234567...13

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型号 品牌 获取价格 描述 数据表
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