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CY62146ELL-45ZSXI

更新时间： 2024-11-23 03:05:55
品牌 Logo 应用领域
赛普拉斯 - CYPRESS /
页数 文件大小 规格书
11页 529K
描述
4-Mbit (256K x 16) Static RAM

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CY62146ELL-45ZSXI 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSOP2
包装说明：TSOP2, TSOP44,.46,32针数：44
Reach Compliance Code：compliantECCN代码：3A991.B.2.A
HTS代码：8542.32.00.41Factory Lead Time：1 week
风险等级：1.31最长访问时间：45 ns
I/O 类型：COMMONJESD-30 代码：R-PDSO-G44
JESD-609代码：e4长度：18.415 mm
内存密度：4194304 bit内存集成电路类型：STANDARD SRAM
内存宽度：16湿度敏感等级：3
功能数量：1端子数量：44
字数：262144 words字数代码：256000
工作模式：ASYNCHRONOUS最高工作温度：85 °C
最低工作温度：-40 °C组织：256KX16
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：TSOP2封装等效代码：TSOP44,.46,32
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE
并行/串行：PARALLEL峰值回流温度（摄氏度）：260
电源：5 V认证状态：Not Qualified
座面最大高度：1.194 mm最大待机电流：0.000007 A
最小待机电流：2 V子类别：SRAMs
最大压摆率：0.02 mA最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.8 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：10.16 mmBase Number Matches：1

CY62146ELL-45ZSXI 数据手册

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CY62146E MoBL®  
4-Mbit (256K x 16) Static RAM  
device into standby mode reduces power consumption by  
more than 99% when deselected (CE HIGH). The input and  
output pins (IO0 through IO15) are placed in a high impedance  
state when:  
Features  
• Very high speed: 45 ns  
• Wide voltage range: 4.5V–5.5V  
• Ultra low standby power  
• Deselected (CE HIGH)  
• Outputs are disabled (OE HIGH)  
— Typical standby current: 1 µA  
• Both byte high enable and byte low enable are disabled  
(BHE, BLE HIGH)  
— Maximum standby current: 7 µA  
• Ultra low active power  
• When the write operation is active (CE LOW and WE LOW)  
— Typical active current: 2 mA @ f = 1 MHz  
• Easy memory expansion with CE and OE features  
• Automatic power down when deselected  
• CMOS for optimum speed and power  
• Offered in Pb-free 44-pin TSOP II package  
To write to the device, take Chip Enable (CE) and Write Enable  
(WE) inputs LOW. If Byte Low Enable (BLE) is LOW, then data  
from IO pins (IO0 through IO7) is written into the location  
specified on the address pins (A0 through A17). If Byte High  
Enable (BHE) is LOW, then data from IO pins (IO8 through  
IO15) is written into the location specified on the address pins  
(A0 through A17).  
Functional Description[1]  
To read from the device, take Chip Enable (CE) and Output  
Enable (OE) LOW while forcing the Write Enable (WE) HIGH.  
If Byte Low Enable (BLE) is LOW, then data from the memory  
location specified by the address pins appears on IO0 to IO7.  
If Byte High Enable (BHE) is LOW, then data from memory  
appears on IO8 to IO15. See the “Truth Table” on page 9 for a  
complete description of read and write modes.  
The CY62146E is a high performance CMOS static RAM  
organized as 256K words by 16 bits. This device features  
advanced circuit design to provide ultra low active current.  
This is ideal for providing More Battery Life™ (MoBL®) in  
portable applications such as cellular telephones. The device  
also has an automatic power down feature that reduces power  
consumption when addresses are not toggling. Placing the  
Logic Block Diagram  
DATA IN DRIVERS  
A10  
A9  
A8  
A7  
A6  
A5  
A4  
A3  
A2  
A1  
A0  
256K x 16  
RAM Array  
IO0–IO7  
IO8–IO15  
COLUMN DECODER  
BHE  
WE  
CE  
OE  
BLE  
Note  
1. For best practice recommendations, refer to the Cypress application note AN1064, SRAM System Guidelines.  
Cypress Semiconductor Corporation  
Document #: 001-07970 Rev. *C  
•
198 Champion Court  
•
San Jose, CA 95134-1709  
•
408-943-2600  
Revised May 4, 2007  
[+] Feedback  
1234567...11

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CY62146ELL-45ZSXI 替代型号

型号 品牌 替代类型 描述 数据表
CY62146ELL-45ZSXA CYPRESS

完全替代

 4-Mbit (256K x 16) Static RAM

与CY62146ELL-45ZSXI相关器件

型号 品牌 获取价格 描述 数据表
CY62146ELL-45ZSXIT INFINEON

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 		4-Mbit (256K x 16) Static RAM Automatic power down when deselected
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 		4-Mbit (256K x 16) Static RAM
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