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CDC303N PDF预览

CDC303N

更新时间： 2024-11-06 21:19:51
品牌 Logo 应用领域
德州仪器 - TI 驱动光电二极管输出元件逻辑集成电路
页数 文件大小 规格书
6页 88K
描述
LOW SKEW CLOCK DRIVER, 6 TRUE OUTPUT(S), 2 INVERTED OUTPUT(S), PDIP16, 0.300 INCH, PLASTIC, DIP-16

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CDC303N 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP, DIP16,.3
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.85
输入调节：STANDARDJESD-30 代码：R-PDIP-T16
长度：19.305 mm逻辑集成电路类型：LOW SKEW CLOCK DRIVER
最大I（ol）：0.048 A功能数量：1
反相输出次数：2端子数量：16
实输出次数：6最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装等效代码：DIP16,.3
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
Prop。Delay @ Nom-Sup：9 ns传播延迟（tpd）：9 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：1 ns
座面最大高度：5.08 mm子类别：Clock Drivers
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：TTL温度等级：COMMERCIAL
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.62 mm最小 fmax：80 MHz
Base Number Matches：1

CDC303N 数据手册

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CDC303  
OCTAL DIVIDE-BY-2 CIRCUIT/CLOCK DRIVER  
SCAS323A – JULY 1990 – REVISED NOVEMBER 1995  
D OR N PACKAGE  
(TOP VIEW)  
Replaces SN74AS303  
Maximum Output Skew Between Same  
Phase Outputs of 1 ns  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
Q2  
Q1  
CLR  
Q3  
Q4  
GND  
GND  
GND  
Q5  
Maximum Pulse Skew of 1 ns  
TTL-Compatible Inputs and Outputs  
Center-Pin V  
Minimize High-Speed Switching Noise  
and GND Configurations  
V
CC  
CC  
V
CC  
CLK  
PRE  
Q8  
Package Options Include Plastic  
Small-Outline (D) Package and Standard  
Plastic (N) 300-mil DIPs  
Q6  
Q7  
description  
The CDC303 contains eight flip-flops designed to have low skew between outputs. The eight outputs (six  
in-phase with CLK and two out-of-phase) toggle on successive CLK pulses. Preset (PRE) and clear (CLR)  
inputs are provided to set the Q and Q outputs high or low independent of the clock (CLK) input.  
The CDC303 has output and pulse-skew parameters t  
when a divide-by-two function is required.  
and t  
to ensure performance as a clock driver  
sk(o)  
sk(p)  
The CDC303 is characterized for operation from 0°C to 70°C.  
FUNCTION TABLE  
INPUTS  
OUTPUTS  
CLR  
L
PRE  
H
CLK Q1–Q6 Q7–Q8  
X
X
X
↑
L
H
L
H
L
H
†
L
†
L
L
L
H
H
Q
Q
Q
Q
0
0
0
0
H
H
L
†
This configuration does not persist when  
PRE or CLR returns to its inactive (high)  
level.  
‡
logic symbol  
15  
Q1  
16  
Q2  
1
10  
11  
PRE  
CLK  
S
T
Q3  
2
Q4  
6
Q5  
7
Q6  
8
14  
CLR  
R
Q7  
9
Q8  
‡
This symbol is in accordance with ANSI/IEEE Std 91-1984 and IEC Publication 617-12.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 1995, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
123456

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