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74LVC1G175GV,125

更新时间： 2024-11-25 14:40:15
品牌 Logo 应用领域
恩智浦 - NXP /
页数 文件大小 规格书
20页 136K
描述
74LVC1G175 - Single D-type flip-flop with reset; positive edge trigger TSOP 6-Pin

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74LVC1G175GV,125 技术参数

是否Rohs认证： 符合生命周期：Transferred
零件包装代码：TSOP包装说明：PLASTIC, SOT-457, SC-74, TSOP-6
针数：6Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.44
系列：LVC/LCX/ZJESD-30 代码：R-PDSO-G6
JESD-609代码：e3长度：2.9 mm
负载电容（CL）：50 pF逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：175000000 Hz最大I（ol）：0.024 A
湿度敏感等级：1位数：1
功能数量：1端子数量：6
最高工作温度：125 °C最低工作温度：-40 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSOP6,.11,37
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：3.3 VProp。Delay @ Nom-Sup：7.5 ns
传播延迟（tpd）：17 ns认证状态：Not Qualified
座面最大高度：1.1 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：1.65 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：Tin (Sn)端子形式：GULL WING
端子节距：0.95 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30触发器类型：POSITIVE EDGE
宽度：1.5 mm最小 fmax：200 MHz
Base Number Matches：1

74LVC1G175GV,125 数据手册

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74LVC1G175  
Single D-type flip-flop with reset; positive-edge trigger  
Rev. 5 — 6 December 2011  
Product data sheet  
1. General description  
The 74LVC1G175 is a low-power, low-voltage single positive edge triggered D-type  
flip-flop with individual data (D) input, clock (CP) input, master reset (MR) input, and Q  
output.  
The master reset (MR) is an asynchronous active LOW input and operates independently  
of the clock input. Information on the data input is transferred to the Q output on the  
LOW-to-HIGH transition of the clock pulse. The D input must be stable one set-up time  
prior to the LOW-to-HIGH clock transition for predictable operation.  
The inputs can be driven from either 3.3 V or 5 V devices. This feature allows the use of  
this device in a mixed 3.3 V and 5 V environment.  
This device is fully specified for partial power-down applications using IOFF. The IOFF  
circuitry disables the output, preventing the damaging backflow current through the device  
when it is powered down.  
Schmitt trigger action at all inputs makes the circuit highly tolerant of slower input rise and  
fall times.  
2. Features and benefits  
Wide supply voltage range from 1.65 V to 5.5 V  
5 V tolerant inputs for interfacing with 5 V logic  
High noise immunity  
Complies with JEDEC standard:  
JESD8-7 (1.65 V to 1.95 V)  
JESD8-5 (2.3 V to 2.7 V)  
JESD8B/JESD36 (2.7 V to 3.6 V).  
ESD protection:  
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V.  
24 mA output drive (VCC = 3.0 V)  
CMOS low power consumption  
Latch-up performance exceeds 250 mA  
Direct interface with TTL levels  
Inputs accept voltages up to 5 V  
Multiple package options  
Specified from 40 C to +85 C and 40 C to +125 C.  
 
 
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74LVC1G175GV,125 替代型号

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