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ICS8624BYT

更新时间： 2024-01-12 09:09:55

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矽成 - ICSI		/
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16页	288K
描述
LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER

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ICS8624BYT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LQFP,	针数：	32
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.33	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	S-PQFP-G32	JESD-609代码：	e3
长度：	7 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
功能数量：	1	反相输出次数：
端子数量：	32	实输出次数：	5
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：	260	传播延迟（tpd）：	4.4 ns
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.025 ns
座面最大高度：	1.6 mm	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7 mm
最小 fmax：	31.25 MHz	Base Number Matches：	1

ICS8624BYT 数据手册

ICS8624

Integrated

Circuit

Systems, Inc.

SKEW, 1-TO-5

IFFERENTIAL

TO-HSTL ZERO

DELAY

BUFFER

GENERAL DESCRIPTION

FEATURES

The ICS8624 is a high performance, 1-to-5

• Fully integrated PLL

ICS

Differential-to-HSTL zero delay buffer and

a member of the HiPerClockS™ family of High

Performance Clock Solutions from ICS. The

ICS8624 has two selectable clock input pairs.

• 5 differential HSTL outputs

HiPerClockS™

• Selectable differential CLKx, nCLKx input pairs

• CLKx, nCLKx pairs can accept the following differential

input levels: LVPECL, LVDS, HSTL, SSTL, HCSL

The CLK0, nCLK0 and CLK1, nCLK1 pair can accept most

standard differential input levels.The VCO operates at a fre-

quency range of 250MHz to 700MHz. Utilizing one of the

outputs as feedback to the PLL, output frequencies up to

700MHz can be regenerated with zero delay with respect to

the input. Dual reference clock inputs support redundant clock

or multiple reference applications.

• Output frequency range: 31.25MHz to 700MHz

• Input frequency range: 31.25MHz to 700MHz

• VCO range: 250MHz to 700MHz

• External feedback for “zero delay” clock regeneration

• Cycle-to-cycle jitter: 25ps (maximum)

• Output skew: 25ps (maximum)

• Static phase offset: 100ps

• 3.3V core, 1.8V output operating supply

• 0°C to 70°C ambient operating temperature

• Lead-Free package available

• Industrial temperature information available upon request

BLOCK DIAGRAM

PIN ASSIGNMENT

nQ0

PLL_SEL

nQ1

÷4, ÷8

32 31 30 29 28 27 26 25

CLK0

nCLK0

nQ2

SEL0

SEL1

V^DDO

CLK1

nCLK1

nQ3

CLK0

nQ3

PLL

nCLK0

CLK1

nQ4

CLK_SEL

ICS8624

nQ2

nCLK1

CLK_SEL

FB_IN

nFB_IN

nQ1

V^DDO

10 11 12 13 14 15 16

SEL0

SEL1

32-Lead LQFP

7mm x 7mm x 1.4mm body package

Y Package

TopView

8624BY

www.icst.com/products/hiperclocks.html

REV. C JUNE 15, 2004

12 3 4 5 6 7...16

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与ICS8624BYT相关器件

型号	品牌	获取价格	描述	数据表
ICS8624I	IDT	获取价格	LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER
ICS8633AF-01	IDT	获取价格	PLL Based Clock Driver, 8633 Series, 3 True Output(s), 0 Inverted Output(s), PDSO28, 5.30
ICS8633AF-01LF	IDT	获取价格	PLL Based Clock Driver, 8633 Series, 3 True Output(s), 0 Inverted Output(s), PDSO28, 5.30
ICS8633AF-01LFT	IDT	获取价格	PLL Based Clock Driver, 8633 Series, 3 True Output(s), 0 Inverted Output(s), PDSO28, 5.30
ICS8634BK-01	IDT	获取价格	PLL Based Clock Driver, 8634 Series, 5 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.9
ICS8634BK-01LF	IDT	获取价格	PLL Based Clock Driver, 8634 Series, 5 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.9
ICS8634BK-01LFT	IDT	获取价格	PLL Based Clock Driver, 8634 Series, 5 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.9
ICS8634BK-01T	IDT	获取价格	PLL Based Clock Driver, 8634 Series, 5 True Output(s), 0 Inverted Output(s), 5 X 5 MM, 0.9
ICS8634BY-01	IDT	获取价格	PLL Based Clock Driver, 8634 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7
ICS8634BY-01LF	IDT	获取价格	PLL Based Clock Driver, 8634 Series, 5 True Output(s), 0 Inverted Output(s), PQFP32, 7 X 7

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