CY23FS04ZI

更新时间： 2024-11-17 22:14:11

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赛普拉斯 - CYPRESS		/
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12页	217K
描述
Failsafe 2.5V/ 3.3V Zero Delay Buffer

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CY23FS04ZI 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	4.40 MM, MO-153, TSSOP-16
针数：	16	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.75	其他特性：	CAN ALSO OPERATE AT 3.3V SUPPLY
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e0
长度：	5 mm	湿度敏感等级：	1
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	最大输出时钟频率：	170 MHz
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	225
电源：	2.5,3.3 V	主时钟/晶体标称频率：	170 MHz
认证状态：	Not Qualified	座面最大高度：	1.1 mm
子类别：	Clock Generators	最大供电电压：	2.625 V
最小供电电压：	2.375 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	TIN LEAD
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	20
宽度：	4.4 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

CY23FS04ZI 数据手册

CY23FS04

Failsafe™ 2.5V/ 3.3V Zero Delay Buffer

Features

Functional Description

• Internal DCXO for continuous glitch-free operation

• Zero input-output propagation delay

• Low-jitter (< 35 ps RMS) outputs

• Low Output-to-Output skew (< 200 ps)

• 4.17 MHz–170 MHz reference input

• Supports industry standard input crystals

• 170 MHz outputs

The CY23FS04 is a FailSafe zero delay buffer with two

reference clock inputs and four phase-aligned outputs. The

device provides an optimum solution for applications where

continuous operation is required in the event of a primary clock

failure.

The continuous, glitch-free operation is achieved by using a

DCXO, which serves as a redundant clock source in the event

of a reference clock failure by maintaining the last frequency

and phase information of the reference clock.

• 5V-tolerant inputs

• Phase-locked loop (PLL) Bypass Mode

• Dual Reference Inputs

The unique feature of the CY23FS04 is that the DCXO is in

fact the primary clocking source, which is synchronized

(phase-aligned) to the external reference clock. When this

external clock is restored, the DCXO automatically resynchro-

nizes to the external clock.

• 16-pin TSSOP

The frequency of the crystal, which will be connected to the

DCXO must be chosen to be an integer factor of the frequency

of the reference clock. This factor is set by two select lines:

S[2:1], please see Table 1. Output power supply, VDD can be

connected to either 2.5V or 3.3V. VDDC is the power supply

pin for internal circuits and must be connected to 3.3V.

• 2.5V or 3.3V output power supplies

• 3.3V core power supply

• Industrial temperature available

Block Diagram

Pin Configuration

XIN XOUT

REF1

REF2

CLKB1

CLKB2

VSS

VDDC

XIN

REFSEL

FBK

CLKA1

CLKA2

VDD

FAIL#/SAFE

XOUT

REFSEL

DCXO

REF1

CLKA[1:2]

CLKB[1:2]

Failsafe^TM

REF2

FBK

PLL

Block

16 pin TSSOP

Decoder

FAIL# /SAFE

S[2:1]

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose, CA 95134

•

408-943-2600

Document #: 38-07304 Rev. *B

Revised October 12, 2004

12 3 4 5 6 7...12

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CY23FS04ZI 替代型号

型号	品牌	替代类型	描述	数据表
CY23FS04ZC	CYPRESS	完全替代	Failsafe 2.5V/ 3.3V Zero Delay Buffer
CY23FS04ZXI	CYPRESS	功能相似	Failsafe⑩ 2.5V/ 3.3V Zero Delay Buffer
CY23FS04ZXC	CYPRESS	功能相似	Failsafe⑩ 2.5V/ 3.3V Zero Delay Buffer

与CY23FS04ZI相关器件

型号	品牌	获取价格	描述	数据表
CY23FS04ZIT	CYPRESS	获取价格	Failsafe 2.5V/ 3.3V Zero Delay Buffer
CY23FS04ZXC	CYPRESS	获取价格	Failsafe⑩ 2.5V/ 3.3V Zero Delay Buffer
CY23FS04ZXC-2	CYPRESS	获取价格	Failsafeâ¢ 2.5V/3.3V Zero Delay Buffer
CY23FS04ZXC-2T	CYPRESS	获取价格	Failsafeâ¢ 2.5V/3.3V Zero Delay Buffer
CY23FS04ZXCT	CYPRESS	获取价格	Failsafe⑩ 2.5V/ 3.3V Zero Delay Buffer
CY23FS04ZXI	CYPRESS	获取价格	Failsafe⑩ 2.5V/ 3.3V Zero Delay Buffer
CY23FS04ZXI-3	CYPRESS	获取价格	Failsafeâ¢ 2.5 V/3.3 V Zero Delay Buffer
CY23FS04ZXI-3T	CYPRESS	获取价格	Clock Driver, ECL Series, 2 True Output(s), 0 Inverted Output(s), PDSO16, 4.40 MM, LEAD FR
CY23FS04ZXIT	CYPRESS	获取价格	Failsafe⑩ 2.5V/ 3.3V Zero Delay Buffer
CY23FS08	CYPRESS	获取价格	Failsafe 2.5V/ 3.3V Zero Delay Buffer

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