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74ALVC16721MTD

更新时间： 2024-09-15 22:56:19

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飞兆/仙童 - FAIRCHILD		触发器
页数	文件大小	规格书
6页	85K
描述
Low Voltage 20-Bit D-Type Flip-Flops with 3.6V Tolerant Inputs and Outputs

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74ALVC16721MTD 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	TSSOP, TSSOP56,.3,20
针数：	56	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.35
系列：	ALVC/VCX/A	JESD-30 代码：	R-PDSO-G56
JESD-609代码：	e3	长度：	14 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	BUS DRIVER
最大频率@ Nom-Sup：	250000000 Hz	最大I（ol）：	0.024 A
湿度敏感等级：	2	位数：	20
功能数量：	1	端口数量：	2
端子数量：	56	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP56,.3,20
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	3.3 V
Prop。Delay @ Nom-Sup：	4 ns	传播延迟（tpd）：	8.8 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	FF/Latches	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	1.65 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
触发器类型：	POSITIVE EDGE	宽度：	6.1 mm

74ALVC16721MTD 数据手册

October 2001

Revised October 2001

74ALVC16721

Low Voltage 20-Bit D-Type Flip-Flops

with 3.6V Tolerant Inputs and Outputs

General Description

The ALVC16721 contains twenty non-inverting D-type

flip-flops with 3-STATE outputs and is intended for bus ori-

ented applications.

Features

■ 1.8V–3.6V V_CCsupply operation

■ 3.6V tolerant inputs and outputs

■ t_PD(CLK to O_n)

The 74ALVC16721 is designed for low voltage (1.65V to

3.6V) V_CCapplications with I/O compatibility up to 3.6V.

4.0 ns max for 3.0V to 3.6V V_CC

4.9 ns max for 2.3V to 2.7V V_CC

8.8 ns max for 1.65V to 1.95V V_CC

The 74ALVC16721 is fabricated with an advanced CMOS

technology to achieve high speed operation while maintain-

ing low CMOS power dissipation.

■ Power-off high impedance inputs and outputs

■ Supports live insertion and withdrawal (Note 1)

■ Uses patented noise/EMI reduction circuitry

■ Latchup conforms to JEDEC JED78

■ ESD performance:

Human body model > 2000V

Machine model > 200V

Note 1: To ensure the high-impedance state during power up or power

down, OE should be tied to V_CCthrough a pull-up resistor; the minimum

value of the resistor is determined by the current-sourcing capability of the

driver.

Ordering Code:

Order Number

Package Number

Package Description

74ALVC16721MTD

MTD56

56-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 6.1mm Wide

Device also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.

Logic Symbol

Pin Descriptions

Pin Names

Description

Output Enable Input (Active LOW)

CLK

Clock Input

D₀–D₁₉

O₀–O₁₉

Inputs

Outputs

Clock Enable Input (Active LOW)

DS500691

www.fairchildsemi.com

12 3 4 5 6

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74ALVC16721MTD 替代型号

型号	品牌	替代类型	描述	数据表
74VCX16821MTD	FAIRCHILD	类似代替	Low Voltage 20-Bit D-Type Flip-Flops with 3.6V Tolerant Inputs and Outputs
74VCX16821MTDX	FAIRCHILD	类似代替	Low Voltage 20-Bit D-Type Flip-Flops with 3.6V Tolerant Inputs and Outputs
74ALVCH162721GRE4	TI	功能相似	3.3-V 20-Bit Flip-Flop With 3-State Outputs 56-TSSOP -40 to 85

与74ALVC16721MTD相关器件

型号	品牌	获取价格	描述	数据表
74ALVC16721MTDX	FAIRCHILD	获取价格	20-Bit D-Type Flip-Flop
74ALVC16821	FAIRCHILD	获取价格	Low Voltage 20-Bit D-Type Flip-Flops with 3.6V Tolerant Inputs and Outputs
74ALVC16821MTD	FAIRCHILD	获取价格	Low Voltage 20-Bit D-Type Flip-Flops with 3.6V Tolerant Inputs and Outputs
74ALVC16821MTDX	FAIRCHILD	获取价格	20-Bit D-Type Flip-Flop
74ALVC16827	FAIRCHILD	获取价格	Low Voltage 20-Bit Buffer/Line Driver with 3.6V Tolerant Inputs and Outputs
74ALVC16827MTD	FAIRCHILD	获取价格	Low Voltage 20-Bit Buffer/Line Driver with 3.6V Tolerant Inputs and Outputs
74ALVC16827MTDX	FAIRCHILD	获取价格	Dual 10-Bit Buffer/Driver
74ALVC16834A	NXP	获取价格	18-bit registered driver with inverted register enable 3-State
74ALVC16834ADGG	NXP	获取价格	18-bit registered driver with inverted register enable 3-State
74ALVC16834ADGG	PHILIPS	获取价格	Bus Driver, 1-Func, 18-Bit, True Output, CMOS, PDSO56

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