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74AC11378

更新时间： 2024-11-19 02:58:19
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德州仪器 - TI /
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8页 108K
描述
HEX D-TYPE FLIP FLOP WITH ENABLE, POSITIVE EDGE TRIGGER

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SCAS150 − APRIL 1991 − REVISED APRIL 1993  
DW OR N PACKAGE  
(TOP VIEW)  
• Contains Six D-Type Flip-Flops  
• Clock Enable Latched to Avoid False  
Clocking  
1Q  
2Q  
3Q  
GND  
GND  
GND  
GND  
4Q  
CLKEN  
1D  
2D  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
17  
16  
15  
14  
• Applications Include: Buffer/Storage  
Registers, Shift Registers, Pattern  
Generators  
3D  
• Flow-Through Architecture Optimizes PCB  
V
CC  
Layout  
V
CC  
• Center-Pin V  
and GND Pin Configurations  
Minimize High-Speed Switching Noise  
CC  
4D  
13 5D  
12 6D  
• EPIC (Enhanced-Performance Implanted  
5Q  
6Q  
CMOS) 1-µm Process  
11  
CLK  
• 500-mA Typical Latch-Up Immunity at 125°C  
• Package Options Include Plastic  
Small-Outline Packages, and Standard  
Plastic 300-mil DIPs  
description  
These circuits are positive-edge-triggered D-type flip-flops with a clock-enable input. Information at the D inputs  
meeting the setup time requirements is transferred to the Q outputs on the positive-going edge of the clock pulse  
if the clock-enable input (CLKEN) is low.  
Clock triggering occurs at a particular voltage level and is not directly related to the transition time of the  
positive-going pulse. When the clock inputs are at either the high or low level, the data (D) input signal has no  
effect at the output. The circuits are designed to prevent false clocking by transitions at the clock-enable  
(CLKEN) input.  
The 74AC11378 is characterized for operation from − 40°C to 85°C.  
FUNCTION TABLE  
(each flip-flop)  
INPUTS  
OUTPUT  
CLKEN  
CLK  
D
Q
H
X
X
Q
O
L
L
↑
↑
L
H
L
H
L
X
X
Q
O
EPIC is a trademark of Texas Instruments Incorporated.  
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Copyright 1993, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
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74AC11378_10 TI

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