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SY89808LTITR

更新时间： 2024-11-05 04:30:07
品牌 Logo 应用领域
麦瑞 - MICREL 时钟驱动器逻辑集成电路
页数 文件大小 规格书
8页 132K
描述
3.3V, 500MHz, 1:9 DIFFERENTIAL HSTL (1.5V) FANOUT BUFFER/TRANSLATOR

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SY89808LTITR 技术参数

是否Rohs认证： 不符合生命周期：Transferred
零件包装代码：QFP包装说明：TQFP, TQFP32,.35SQ,32
针数：32Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.45
Is Samacsys：N系列：89808
输入调节：DIFFERENTIAL MUXJESD-30 代码：S-PQFP-G32
JESD-609代码：e0长度：7 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：2
功能数量：1反相输出次数：
端子数量：32实输出次数：9
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TQFP
封装等效代码：TQFP32,.35SQ,32封装形状：SQUARE
封装形式：FLATPACK, THIN PROFILE峰值回流温度（摄氏度）：240
电源：1.8,3.3 V传播延迟（tpd）：1.2 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.025 ns
座面最大高度：1.2 mm子类别：Clock Drivers
最大供电电压 (Vsup)：3.45 V最小供电电压 (Vsup)：3.15 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.8 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：7 mm
最小 fmax：500 MHzBase Number Matches：1

SY89808LTITR 数据手册

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®  
3.3V, 500MHz, 1:9 DIFFERENTIAL  
HSTL (1.5V) FANOUT BUFFER/  
TRANSLATOR  
®
Precision Edge  
SY89808L  
FEATURES  
■ 9 differential HSTL (1.5V compatible) output pairs  
■ 500MHz maximum clock frequency  
■ Triple-buffered enable function  
®
Precision Edge  
DESCRIPTION  
■ 3.3V core supply, 1.8V output supply for reduced  
power  
The SY89808L is a High-Performance Bus Clock Driver with  
9 differential HSTL (High-Speed Transceiver Logic) 1.5V  
compatible output pairs. The part is designed for use in low-  
voltage (3.3V/1.8V) applications which require a large number  
of outputs to drive precisely aligned, ultra-low skew signals to  
their destination. The input is multiplexed from either HSTL or  
LVPECL (Low-Voltage Positive-Emitter-Coupled Logic) by the  
CLK_SEL pin.  
■ LVPECL and HSTL inputs  
■ HSTL outputs drive 50Ω to ground with no  
offset voltage  
■ Low pin-to-pin skew (25ps max.)  
■ Guaranteed over industrial –40°C to +85°C  
temperature range  
■ Available in 32-pin TQFP package  
The Output Enable (OE) is synchronous and triple-buffered  
so that the outputs will only be enabled/disabled when they are  
alreadyintheLOWstate.Thisavoidsanypotentialofgenerating  
a runt clock pulse when the device is enabled/disabled, as can  
occur with an asynchronous control. The triple-buffering feature  
provides a three-clock delay from the time the OE input is  
asserted/de-asserted to when the clock appears at the outputs.  
APPLICATIONS  
■ Workstations  
■ Parallel processor-based systems  
■ High-performance computing  
■ Communications  
The SY89808L features an ultra-low pin-to-pin skew of less  
than 25ps. The SY89808L is available in a 32-TQFP space  
saving package, enabling a lower overall cost solution.  
TRUTH TABLE  
OE(1)  
CLK_SEL  
Q0 – Q8  
LOW  
/Q0 – /Q8  
HIGH  
LOGIC SYMBOL  
0
0
1
1
0
1
0
1
LOW  
HIGH  
CLK_SEL  
HSTL_CLK  
LVPECL_CLK  
/HSTL_CLK  
/LVPECL_CLK  
HSTL_CLK  
0
/HSTL_CLK  
9
Notes:  
Q0 — Q8  
1. The OE (output enable) signal is synchronized with the low level of the  
HSTL_CLK and LVPECL_CLK signal.  
9
/Q0 — /Q8  
LVPECL_CLK  
1
TYPICAL PERFORMANCE  
EN  
/LVPECL_CLK  
ENABLE  
LOGIC  
Output Amplitude  
vs. Frequency  
OE  
900  
800  
700  
600  
500  
400  
300  
200  
FREQUENCY (MHz)  
Precision Edge is a registered trademark of Micrel, Inc.  
Rev.: E  
Amendment: /0  
M9999-091405  
hbwhelp@micrel.com or (408) 955-1690  
1
Issue Date: September 2005  
12345678

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SY89808LTITR 替代型号

型号 品牌 替代类型 描述 数据表
SY89808LTI MICREL

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