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NB3V8312CFAG

更新时间： 2024-11-23 12:18:23
品牌 Logo 应用领域
安森美 - ONSEMI /
页数 文件大小 规格书
11页 199K
描述
Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer

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NB3V8312CFAG 技术参数

是否无铅： 不含铅生命周期：Active
包装说明：LQFP,针数：32
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：4 weeks风险等级：1.63
Samacsys Description：NULL其他特性：ALSO OPERATES AT 2.5V, 3.3V SUPPLY VOLTAGE
系列：NB3V输入调节：STANDARD
JESD-30 代码：S-PQFP-G32JESD-609代码：e3
长度：7 mm逻辑集成电路类型：LOW SKEW CLOCK DRIVER
湿度敏感等级：2功能数量：1
反相输出次数：端子数量：32
实输出次数：12最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE WITH SERIES RESISTOR
封装主体材料：PLASTIC/EPOXY封装代码：LQFP
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE
传播延迟（tpd）：4.2 nsSame Edge Skew-Max（tskwd）：0.15 ns
座面最大高度：1.6 mm最大供电电压 (Vsup)：2 V
最小供电电压 (Vsup)：1.6 V标称供电电压 (Vsup)：1.8 V
表面贴装：YES温度等级：INDUSTRIAL
端子面层：Tin (Sn)端子形式：GULL WING
端子节距：0.8 mm端子位置：QUAD
宽度：7 mm最小 fmax：250 MHz
Base Number Matches：1

NB3V8312CFAG 数据手册

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NB3V8312C  
Ultra-Low Jitter, Low Skew  
1:12 LVCMOS/LVTTL Fanout  
Buffer  
The NB3V8312C is a high performance, low skew LVCMOS  
fanout buffer which can distribute 12 ultra−low jitter clocks from an  
LVCMOS/LVTTL input up to 250 MHz.  
http://onsemi.com  
The 12 LVCMOS output pins drive 50 W series or parallel  
terminated transmission lines. The outputs can also be disabled to a  
high impedance (tri−stated) via the OE input, or enabled when High.  
The NB3V8312C provides an enable input, CLK_EN pin, which  
synchronously enables or disables the clock outputs while in the LOW  
state. Since this input is internally synchronized to the input clock,  
changing only when the input is LOW, potential output glitching or  
runt pulse generation is eliminated.  
32  
1
QFN32  
MN SUFFIX  
CASE 488AM  
LQFP−32  
FA SUFFIX  
CASE 873A  
Separate V  
core and V  
output supplies allow the output  
V
DD  
DDO  
DDO  
buffers to operate at the same supply as the V (V = V ) or  
V
DD  
DD  
DDO  
DD  
Q0  
Q1  
Q2  
Q3  
Q4  
Q5  
Q6  
Q7  
Q8  
Q9  
Q10  
Q11  
GND  
from a lower supply voltage. Compared to single−supply operation,  
dual supply operation enables lower power consumption and  
output−level compatibility.  
R
PU  
CLK_EN  
D
The V core supply voltage can be set to 3.3 V, 2.5 V or 1.8 V,  
Q
DD  
while the V  
output supply voltage can be set to 3.3 V, 2.5 V, or  
DDO  
1.8 V, with the constraint that V ≥ V  
.
DD  
DDO  
This buffer is ideally suited for various networking, telecom, server  
and storage area networking, RRU LO reference distribution, medical  
and test equipment applications.  
CLK  
R
PD  
Features  
• Power Supply Modes:  
V
DD  
(Core) / V  
(Outputs)  
DDO  
3.3 V  
3.3 V  
3.3 V  
2.5 V  
2.5 V  
1.8 V  
/ 3.3 V  
/ 2.5 V  
/ 1.8 V  
/ 2.5 V  
/ 1.8 V  
/ 1.8 V  
R
PU  
OE  
Figure 1. Simplified Logic Diagram  
• 250 MHz Maximum Clock Frequency  
• Accepts LVCMOS, LVTTL Clock Inputs  
• LVCMOS Compatible Control Inputs  
• 12 LVCMOS Clock Outputs  
ORDERING AND MARKING INFORMATION  
See detailed ordering and shipping information on page 9 of  
this data sheet.  
• Synchronous Clock Enable  
Applications  
• Output Enable to High Z State Control  
• 150 ps Max. Skew Between Outputs  
• Temp. Range −40°C to +85°C  
• 32−pin LQFP and QFN Packages  
• These are Pb−Free Devices  
• Networking  
• Telecom  
• Storage Area Network  
End Products  
• Servers  
• Routers  
• Switches  
© Semiconductor Components Industries, LLC, 2013  
1
Publication Order Number:  
August, 2013 − Rev. 0  
NB3V8312C/D  
1234567...11

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NB3V8312CFAG 替代型号

型号 品牌 替代类型 描述 数据表
NB3V8312CMNR4G ONSEMI

完全替代

 Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer
NB3V8312CMNG ONSEMI

完全替代

 Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer
NB3V8312CFAR2G ONSEMI

完全替代

 Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer

与NB3V8312CFAG相关器件

型号 品牌 获取价格 描述 数据表
NB3V8312CFAR2G ONSEMI

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 		Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer
NB3V8312CMNG ONSEMI

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 		Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer
NB3V8312CMNR4G ONSEMI

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 		Ultra-Low Jitter, Low Skew 1:12 LVCMOS/LVTTL Fanout Buffer
NB3W1200LMNG ONSEMI

获取价格

 		Differential 1:12 HCSL or Push-Pull Clock ZDB/Fanout Buffer for PCle
NB3W1200LMNTXG ONSEMI

获取价格

 		Differential 1:12 HCSL or Push-Pull Clock ZDB/Fanout Buffer for PCle
NB3W1900L ONSEMI

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 		Differential 1:19 HCSL-Compatible Push‐Pull
NB3W1900L_16 ONSEMI

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 		3.3 V 100/133 MHz Differential 1:19 HCSL-Comp
NB3W1900L_18 ONSEMI

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 		Differential 1:19 HCSL-Compatible Push‐Pull
NB3W1900LMNG ONSEMI

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 		Differential 1:19 HCSL-Compatible Push‐Pull
NB3W1900LMNTXG ONSEMI

获取价格

 		Differential 1:19 HCSL-Compatible Push‐Pull

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