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MC100ES6056DTR2 PDF预览

MC100ES6056DTR2

更新时间： 2024-11-06 05:10:27
品牌 Logo 应用领域
艾迪悌 - IDT 复用器逻辑集成电路光电二极管
页数 文件大小 规格书
9页 1111K
描述
2.5V, 3.3V ECL/LVPECL/LVDS DUAL DIFFERENTIAL 2:1 MULTIPLEXER

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MC100ES6056DTR2 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP, TSSOP20,.25针数：20
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.22
其他特性：ECL MODE: VCC = 0V WITH VEE = -2.375V TO -3.8V系列：100E
JESD-30 代码：R-PDSO-G20JESD-609代码：e0
长度：6.5 mm逻辑集成电路类型：MULTIPLEXER
湿度敏感等级：1功能数量：2
输入次数：2输出次数：1
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP20,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：225电源：-4.5 V
最大电源电流（ICC）：60 mAProp。Delay @ Nom-Sup：0.5 ns
传播延迟（tpd）：0.5 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Multiplexer/Demultiplexers
最大供电电压 (Vsup)：3.8 V最小供电电压 (Vsup)：2.375 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
技术：ECL温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn85Pb15)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：4.4 mm
Base Number Matches：1

MC100ES6056DTR2 数据手册

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2.5V, 3.3V ECL/LVPECL/LVDS DUAL  
DIFFERENTIAL 2:1 MULTIPLEXER  
MC100ES6056  
The MC100ES6056 is a dual, fully differential 2:1 multiplexer. The differential data path  
makes the device ideal for multiplexing low skew clock or other skew sensitive signals.  
Multiple VBB pins are provided.  
DT SUFFIX  
The VBB pin, an internally generated voltage supply, is available to this device only. For  
single-ended input conditions, the unused differential input is connected to VBB as a  
switching reference voltage. VBB may also rebias AC coupled inputs. When used,  
decouple VBB and VCC via a 0.01 µF capacitor and limit current sourcing or sinking to 0.5  
mA. When not used, VBB should be left open.  
20-LEAD TSSOP PACKAGE  
CASE 948E-03  
The device features both individual and common select inputs to address both data  
path and random logic applications.  
EJ SUFFIX  
20-LEAD TSSOP PACKAGE  
Pb-FREE PACKAGE  
CASE 948E-03  
The 100ES Series contains temperature compensation.  
Features  
•
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•
360 ps Typical Propagation Delays  
Maximum Frequency > 3 GHz Typical  
PECL Mode Operating Range: VCC = 2.375 V to 3.8 V with VEE = 0 V  
ECL Mode Operating Range: VCC = 0 V with VEE = –2.375 V to –3.8 V  
Open Input Default State  
Separate and Common Select  
Q Output Will Default LOW with Inputs Open or at VEE  
VBB Outputs  
EG SUFFIX  
20-LEAD SOIC PACKAGE  
Pb-FREE PACKAGE  
CASE 751D-07  
ORDERING INFORMATION  
LVDS Input Compatible  
20-Lead Pb-Free Package Available  
Device  
Package  
TSSOP-20  
MC100ES6056DT  
MC100ES6056DTR2  
MC100ES6056EJ  
MC100ES6056EJR2  
TSSOP-20  
TSSOP-20 (Pb-Free)  
TSSOP-20 (Pb-Free)  
MC100ES6056EG  
MC100ES6056EGR2  
SOIC-20 (Pb-Free)  
SOIC-20 (Pb-Free)  
VCC  
20  
Q0  
19  
Q0 SEL0COM_SEL SEL1 VCC  
Q1  
13  
Q1  
12  
VEE  
11  
18  
17  
16  
15  
14  
1
0
1
0
1
2
3
4
5
6
7
8
9
10  
D0a D0a VBB0 D0b  
D0b  
D1a  
D1a  
VBB1 D1b  
D1b  
Warning: All VCC and VEE pins must be externally connected to  
Power Supply to guarantee proper operation.  
Figure 1. 20-Lead Pinout (Top View) and Logic Diagram  
IDT™ / ICS™ 2:1 MULTIPLEXER  
1
MC100ES6056 REV. 5 JULY 16, 2007  
1234567...9

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与MC100ES6056DTR2相关器件

型号 品牌 获取价格 描述 数据表
MC100ES6056DW MOTOROLA

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 		100E SERIES, DUAL 2 LINE TO 1 LINE MULTIPLEXER, COMPLEMENTARY OUTPUT, PDSO20, SOIC-20
MC100ES6056EG IDT

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 		2.5V, 3.3V ECL/LVPECL/LVDS DUAL DIFFERENTIAL 2:1 MULTIPLEXER
MC100ES6056EGR2 IDT

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 		2.5V, 3.3V ECL/LVPECL/LVDS DUAL DIFFERENTIAL 2:1 MULTIPLEXER
MC100ES6056EJ IDT

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 		2.5V, 3.3V ECL/LVPECL/LVDS DUAL DIFFERENTIAL 2:1 MULTIPLEXER
MC100ES6056EJ FREESCALE

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 		2.5 V/3.3 V ECL/PECL/LVDS Dual Differential 2:1 Multiplexer
MC100ES6056EJR2 FREESCALE

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 		2.5 V/3.3 V ECL/PECL/LVDS Dual Differential 2:1 Multiplexer
MC100ES6056EJR2 IDT

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 		2.5V, 3.3V ECL/LVPECL/LVDS DUAL DIFFERENTIAL 2:1 MULTIPLEXER
MC100ES60T22 FREESCALE

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 		3.3 V Dual LVTTL/LVCMOS to Differential LVPECL Translator
MC100ES60T22D FREESCALE

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 		3.3 V Dual LVTTL/LVCMOS to Differential LVPECL Translator
MC100ES60T22DR2 FREESCALE

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 		3.3 V Dual LVTTL/LVCMOS to Differential LVPECL Translator

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