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M74HC374TTR

更新时间： 2024-11-04 05:00:55
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 触发器输出元件
页数 文件大小 规格书
11页 241K
描述
OCTAL D-TYPE FLIP FLOP WITH 3 STATE OUTPUT NON INVERTING

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M74HC374TTR 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP, TSSOP20,.25针数：20
Reach Compliance Code：not_compliantHTS代码：8542.39.00.01
风险等级：5.23系列：HC/UH
JESD-30 代码：R-PDSO-G20JESD-609代码：e0
长度：6.5 mm负载电容（CL）：50 pF
逻辑集成电路类型：BUS DRIVER最大频率@ Nom-Sup：21000000 Hz
最大I（ol）：0.006 A位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP20,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/6 V传播延迟（tpd）：285 ns
认证状态：Not Qualified座面最大高度：1.2 mm
子类别：FF/Latches最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：4.5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：4.4 mm
Base Number Matches：1

M74HC374TTR 数据手册

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M74HC374  
OCTAL D-TYPE FLIP FLOP  
WITH 3 STATE OUTPUT NON INVERTING  
■
■
■
■
■
■
■
HIGH SPEED:  
= 90MHz (TYP.) at V = 6V  
f
MAX  
CC  
LOW POWER DISSIPATION:  
= 4µA(MAX.) at T =25°C  
I
CC  
A
HIGH NOISE IMMUNITY:  
= V = 28 % V (MIN.)  
V
NIH  
NIL  
CC  
DIP  
SOP  
TSSOP  
T & R  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 6mA (MIN)  
OH  
OL  
BALANCED PROPAGATION DELAYS:  
t
t
ORDER CODES  
PACKAGE  
PLH  
PHL  
WIDE OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 6V  
TUBE  
V
CC  
DIP  
SOP  
M74HC374B1R  
M74HC374M1R  
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 374  
M74HC374RM13TR  
M74HC374TTR  
TSSOP  
DESCRIPTION  
The M74HC374 is an high speed CMOS OCTAL  
D-TYPE FLIP FLOP WITH 3-STATE OUTPUTS  
NON INVERTING fabricated with sub-micron  
level) and while OE is high the outputs will be in  
a high impedance state.  
The output control does not affect the internal  
operation of flip-flops; that is, the old data can be  
retained or the new data can be entered even  
while the outputs are off.  
All inputs are equipped with protection circuits  
against static discharge and transient excess  
voltage.  
2
silicon gate C MOS technology.  
This 8 bit D-TYPE FLIP FLOP is controlled by a  
clock input (CK) and an output enable input (OE).  
On the positive transition of the clock, the Q  
outputs will be set to the logic state that were  
setup at the D inputs.  
While the OE input is at low level, the eight outputs  
will be in a normal logic state (high or low logic  
PIN CONNECTION AND IEC LOGIC SYMBOLS  
July 2001  
1/11  
1234567...11

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型号 品牌 获取价格 描述 数据表
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