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M74HC192B1R

更新时间： 2024-10-31 22:25:23

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意法半导体 - STMICROELECTRONICS		计数器触发器逻辑集成电路光电二极管输出元件
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15页	313K
描述
SYNCHRONOUS UP/DOWN DECADE(,BINARY) COUNTER

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M74HC192B1R 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	DIP	包装说明：	PLASTIC, DIP-16
针数：	16	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.47
Is Samacsys：	N	其他特性：	TCO UP AND TCO DOWN OUTPUTS; SEPARATE UP/DOWN CLOCK
计数方向：	BIDIRECTIONAL	系列：	HC/UH
JESD-30 代码：	R-PDIP-T16	JESD-609代码：	e3
负载电容（CL）：	50 pF	负载/预设输入：	YES
逻辑集成电路类型：	DECADE COUNTER	最大频率@ Nom-Sup：	17000000 Hz
最大I（ol）：	0.004 A	工作模式：	SYNCHRONOUS
位数：	4	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装等效代码：	DIP16,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
峰值回流温度（摄氏度）：	245	电源：	2/6 V
传播延迟（tpd）：	285 ns	认证状态：	Not Qualified
座面最大高度：	5.1 mm	子类别：	Counters
最大供电电压 (Vsup)：	6 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	4.5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子面层：	Matte Tin (Sn)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	触发器类型：	POSITIVE EDGE
宽度：	7.62 mm	最小 fmax：	20 MHz
Base Number Matches：	1

M74HC192B1R 数据手册

M54/M74HC192

M54/M74HC193

HC192 - SYNCHRONOUS UP/DOWN DECADE COUNTER

HC193 - SYNCHRONOUS UP/DOWN BINARY COUNTER

HIGH SPEED

f_MAX= 54 MHz (TYP.) AT V_CC= 5 V

LOW POWER DISSIPATION

I_CC= 4 µA (MAX.) AT T_A= 25 °C

HIGH NOISE IMMUNITY

V_NIH= V_NIL= 28 % V_CC(MIN.)

OUTPUT DRIVE CAPABILITY

10 LSTTL LOADS

SYMMETRICAL OUTPUT IMPEDANCE

|I_OH| = I_OL= 4 mA (MIN.)

BALANCED PROPAGATION DELAYS

t_PLH= t_PHL

WIDE OPERATING VOLTAGE RANGE

B1R

(Plastic Package)

F1R

(Ceramic Package)

M1R

(Micro Package)

C1R

(Chip Carrier)

V_CC(OPR) = 2 V TO 6 V

PIN AND FUNCTION COMPATIBLE WITH

54/74LS192-193

ORDER CODES :

M54HCXXXF1R

M74HCXXXB1R

M74HCXXXM1R

M74HCXXXC1R

DESCRIPTION

The M54/74HC192/193 are ahigh speed CMOSSYN-

CHRONOUS UP/DOWN DECADE COUNTERS fab-

ricated in silicon gate C²MOS technology. They have

the same high speed performance of LSTTL combined

with true CMOS low power consumption. The counter

has two separate clock inputs, an UP COUNT input

and a DOWN COUNT input. All outputs of the flip-flop

are simultaneously triggered on the low to high transi-

tion of either clock while the other input isheld high. The

direction of counting is determined by which input is

clocked. This counter may be preset by entering the

desired data on the DATA A, DATA B, DATA C, and

DATA D input. When the LOAD input is taken low the

data is loaded independently of either clock input. This

feature allows the counters to be used as divide-by-n

counters by modifying the count length with the preset

inputs. In addition the counter can also be cleared. This

is accomplished by inputting a high on the CLEAR

input. All 4 internal stages are set to low independently

of either COUNT input. Both a BORROW and CARRY

output areprovided toenable cascadingof bothupand

down counting functions. The BORROW output pro-

ducesa negative going pulse when thecounter under-

flows and the CARRY outputs a pulse when the

counter overflows. The counter can be cascaded by

connecting the CARRY and BORROW outputs of one

device to the COUNT UP and COUNT DOWN inputs,

respectively, of the next device. All inputs are equipped

with protection circuits against static discharge and

transient excess voltage.

PIN CONNECTIONS (top view)

NC =

No Internal

Connection

October 1992

1/15

12 3 4 5 6 7...15

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