M74HC164C1R

更新时间： 2024-01-29 13:29:56

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意法半导体 - STMICROELECTRONICS		移位寄存器触发器逻辑集成电路
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8 BIT SIPO SHIFT REGISTER

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M74HC164C1R 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	QFN	包装说明：	CC-20
针数：	20	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.82
计数方向：	RIGHT	系列：	HC/UH
JESD-30 代码：	S-PQCC-J20	JESD-609代码：	e3
长度：	8.9662 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	SERIAL IN PARALLEL OUT	最大频率@ Nom-Sup：	25000000 Hz
位数：	8	功能数量：	1
端子数量：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装等效代码：	LDCC20,.4SQ	封装形状：	SQUARE
封装形式：	CHIP CARRIER	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	2/6 V	传播延迟（tpd）：	40 ns
认证状态：	Not Qualified	座面最大高度：	4.57 mm
子类别：	Shift Registers	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
触发器类型：	POSITIVE EDGE	宽度：	8.9662 mm
最小 fmax：	25 MHz	Base Number Matches：	1

M74HC164C1R 数据手册

M54HC164

M74HC164

8 BIT SIPO SHIFT REGISTER

HIGH SPEED

_PD= 15 ns (TYP.) AT V_CC= 5 V

LOW POWER DISSIPATION

I_CC= 4 µA (MAX.) AT T_A= 25 °C

OUTPUT DRIVE CAPABILITY

10 LSTTL LOADS

BALANCED PROPAGATION DELAYS

t_PLH= t_PHL

SYMMETRICAL OUTPUT IMPEDANCE

I_OL= I_OH= 4 mA (MIN.)

B1R

(Plastic Package)

F1R

(Ceramic Package)

HIGH NOISE IMMUNITY

V_NIH= V_NIL= 28 % V_CC(MIN.)

WIDE OPERATING VOLTAGE RANGE

V_CC(OPR) = 2 V TO 6 V

PIN AND FUNCTION COMPATIBLE

WITH 54/74LS164

M1R

(Micro Package)

C1R

(Chip Carrier)

ORDER CODES :

M54HC164F1R

M74HC164B1R

M74HC164M1R

M74HC164C1R

PIN CONNECTIONS (top view)

DESCRIPTION

The M54/74HC164 is a high speed CMOS 8 BIT

SIPO SHIFT REGISTER fabricated in silicon gate

C²MOS technology. It has the same highspeed per-

formance of LSTTL combined with true CMOS low

power consumption.

The HC164 is an 8 bit shift register with serial data

entry and an output from each of the eight stages.

Data is entered serially through one of two inputs (A

or B), either of these inputs can beused asan active

high enable for data entry through the other input.

An unused input must be high, or both inputs con-

nected together. Each low-to-high transition on the

clock input shifts data one place to the right and

entersintoQA, thelogic NAND of the twodata inputs

(A B), the data that existed before the rising clock

edge. A low level on the clear input overrides all

other inputs and clearsthe register asynchronously,

forcing all Q outputs low.

NC =

All inputs are equipped with protection circuits

against static discharge and transient excess volt-

age.

No Internal

Connection

October 1992

1/12

12 3 4 5 6 7...12

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