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ICS558AG-02LNT

更新时间: 2024-11-11 14:51:19
品牌 Logo 应用领域
艾迪悌 - IDT 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
6页 128K
描述
Low Skew Clock Driver, 558 Series, 4 True Output(s), 0 Inverted Output(s), CMOS, PDSO16, 4.40 MM, 0.65 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-16

ICS558AG-02LNT 技术参数

是否无铅:不含铅是否Rohs认证:符合
生命周期:Obsolete零件包装代码:TSSOP
包装说明:4.40 MM, 0.65 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-16针数:16
Reach Compliance Code:compliantHTS代码:8542.39.00.01
风险等级:5.75Is Samacsys:N
系列:558输入调节:DIFFERENTIAL
JESD-30 代码:R-PDSO-G16JESD-609代码:e3
长度:5 mm逻辑集成电路类型:LOW SKEW CLOCK DRIVER
功能数量:1反相输出次数:
端子数量:16实输出次数:4
最高工作温度:70 °C最低工作温度:
输出特性:3-STATE封装主体材料:PLASTIC/EPOXY
封装代码:TSSOP封装形状:RECTANGULAR
封装形式:SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度(摄氏度):260
传播延迟(tpd):12 ns认证状态:Not Qualified
座面最大高度:1.2 mm最大供电电压 (Vsup):3.465 V
最小供电电压 (Vsup):3.135 V标称供电电压 (Vsup):3.3 V
表面贴装:YES技术:CMOS
温度等级:COMMERCIAL端子面层:MATTE TIN
端子形式:GULL WING端子节距:0.65 mm
端子位置:DUAL处于峰值回流温度下的最长时间:30
宽度:4.4 mmBase Number Matches:1

ICS558AG-02LNT 数据手册

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DATASHEET  
LVHSTL TO CMOS CLOCK DIVIDER  
ICS558A-02  
Description  
Features  
The ICS558A-02 accepts a high-speed LVHSTL input and  
provides four CMOS low skew outputs from a selectable  
internal divider (divide by 3, divide by 4). The four outputs  
are split into two banks of two outputs. Each bank has a  
separate output enable to tri-state the output buffers.  
16-pin TSSOP package  
LVHSTL inputs  
Accepts up to 250 MHz input frequency  
Four low skew (<250 ps) outputs  
Selectable internal divider of 3 or 4  
Operating voltage of 3.3 V  
TM  
The ICS558A-02 is a member of the IDT Clock Blocks  
family of clock generation, synchronization, and distribution  
devices.  
Lead-free, RoHS compliant package  
Block Diagram  
VDD  
OE0  
4
CLK1  
CLK2  
HCLK  
HCLK  
Output Divide  
/3 or /4  
CLK3  
CLK4  
SEL  
3
OE1  
GND  
IDT™ LVHSTL TO CMOS CLOCK DIVIDER  
1
ICS558A-02  
REV D 051310  

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