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ICS558AG-02T

更新时间: 2024-11-07 21:04:39
品牌 Logo 应用领域
艾迪悌 - IDT 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
6页 131K
描述
Low Skew Clock Driver, 558 Series, 4 True Output(s), 0 Inverted Output(s), CMOS, PDSO16, 4.40 MM, 0.65 MM PITCH, MO-153, TSSOP-16

ICS558AG-02T 技术参数

是否Rohs认证: 不符合生命周期:Obsolete
零件包装代码:TSSOP包装说明:TSSOP,
针数:16Reach Compliance Code:compliant
HTS代码:8542.39.00.01风险等级:5.81
系列:558输入调节:DIFFERENTIAL
JESD-30 代码:R-PDSO-G16JESD-609代码:e0
长度:5 mm逻辑集成电路类型:LOW SKEW CLOCK DRIVER
湿度敏感等级:1功能数量:1
反相输出次数:端子数量:16
实输出次数:4最高工作温度:70 °C
最低工作温度:输出特性:3-STATE
封装主体材料:PLASTIC/EPOXY封装代码:TSSOP
封装形状:RECTANGULAR封装形式:SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度(摄氏度):240传播延迟(tpd):12 ns
认证状态:Not Qualified座面最大高度:1.2 mm
最大供电电压 (Vsup):3.465 V最小供电电压 (Vsup):3.135 V
标称供电电压 (Vsup):3.3 V表面贴装:YES
技术:CMOS温度等级:COMMERCIAL
端子面层:TIN LEAD端子形式:GULL WING
端子节距:0.65 mm端子位置:DUAL
处于峰值回流温度下的最长时间:20宽度:4.4 mm
Base Number Matches:1

ICS558AG-02T 数据手册

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DATASHEET  
LVHSTL TO CMOS CLOCK DIVIDER  
ICS558A-02  
Description  
Features  
The ICS558A-02 accepts a high-speed LVHSTL input and  
provides four CMOS low skew outputs from a selectable  
internal divider (divide by 3, divide by 4). The four outputs  
are split into two banks of two outputs. Each bank has a  
separate output enable to tri-state the output buffers.  
16-pin TSSOP package  
LVHSTL inputs  
Accepts up to 250 MHz input frequency  
Four low skew (<250 ps) outputs  
Selectable internal divider of 3 or 4  
Operating voltage of 3.3 V  
TM  
The ICS558A-02 is a member of the IDT Clock Blocks  
family of clock generation, synchronization, and distribution  
devices.  
Available in a lead-free, RoHS compliant package  
NOTE: EOL for non-green parts to occur on  
5/13/10 per PDN U-09-01  
Block Diagram  
VDD  
OE0  
4
CLK1  
CLK2  
HCLK  
HCLK  
Output Divide  
/3 or /4  
CLK3  
CLK4  
SEL  
3
OE1  
GND  
IDT™ LVHSTL TO CMOS CLOCK DIVIDER  
1
ICS558A-02  
REV C 092409  

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