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ICS558G-02LFT

更新时间： 2024-09-17 14:42:43

品牌	Logo	应用领域
艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
5页	117K
描述
Low Skew Clock Driver, 4 True Output(s), 0 Inverted Output(s), CMOS, PDSO16, 0.173 INCH, MO-153, TSSOP-16

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ICS558G-02LFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	16
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.77	输入调节：	DIFFERENTIAL
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e3
长度：	5 mm	逻辑集成电路类型：	LOW SKEW CLOCK DRIVER
功能数量：	1	反相输出次数：
端子数量：	16	实输出次数：	4
最高工作温度：	70 °C	最低工作温度：
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	12 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.25 ns	座面最大高度：	1.2 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
Base Number Matches：	1

ICS558G-02LFT 数据手册

ICS558-02

LVHSTL TO CMOS CLOCK DIVIDER

Description

Features

The ICS558-02 accepts a high-speed LVHSTL input

and provides four CMOS low skew outputs from a

selectable internal divider (divide by 3, divide by 4). The

four outputs are split into two banks of two outputs.

Each bank has a separate output enable to tri-state the

output buffers.

• 16-pin TSSOP package

• LVHSTL inputs

• Accepts up to 250 MHz input frequency

• Four low skew (<250 ps) outputs

• Selectable internal divider of 3 or 4

• Operating voltage of 3.3 V

The ICS558-02 is a member of the ICS Clock Blocks

family of clock generation, synchronization, and

distribution devices.

Block Diagram

VDD

OE0

CLK1

CLK2

HCLK

Output Divide

/3 or /4

CLK3

CLK4

SEL

OE1

GND

MDS 558-02 D

Revision 020504

Integrated Circuit Systems ● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com

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型号	品牌	获取价格	描述	数据表
ICS558G-02T	ICSI	获取价格	LVHSTL TO CMOS CLOCK DIVIDER
ICS570	ICSI	获取价格	Multiplier and Zero Delay Buffer
ICS570-01	IDT	获取价格	MULTIPLIER AND ZERO DELAY BUFFER
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