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CYW2338ZITR

更新时间： 2024-11-28 13:07:15
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 预分频器
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CYW2338ZITR 数据手册

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12338\CYW2338  
PRELIMINARY  
CYW2338  
Dual Serial Input PLL with 2.5- and 1.1-GHz Prescalers  
Features  
Applications  
• Operating voltage 2.7V to 5.5V  
• Operating frequency to 2.5 GHz on PLL1 and 1.1 GHz  
on PLL2 with prescaler ratios of 64/65 and 128/129  
The Cypress CYW2338 is a dual serial input PLL frequency  
synthesizer designed for high performance dual conversion  
TV, VCR, and Set-top tuner sections, as well as downstream  
receivers for cable modems. The CYW2338 is also well suited  
for high-volume, low-cost wireless communications applica-  
tions. One 2.5-GHz and 1.1-GHz prescaler, each with pulse  
swallow capability are included. The device operates from  
2.7V and dissipates only 27 mW.  
• Lock detect feature  
µA typical at 3.0V  
• Power-down mode ICC < 1  
• Serial data input accepts data clock rates as low as  
1 kHz  
• Low power/voltage operation with low current standby  
mode  
• On-chip reference oscillator  
• Available in a 20-pin TSSOP (Thin Shrink Small Outline  
Package)  
• Available in a 24-pin CSP (Chip Scale Package)  
• Available in a 20-pin MLF  
(Mirco Lead Frame Package)  
Dual PLL Block Diagram  
GND (4)  
GND (7)  
VCC1 (1)  
VCC2 (20)  
VP1 (2)  
FIN1 (5)  
Prescaler  
64/65 or  
128/129  
fp1  
Binary 7-Bit  
Swallow Counter  
Binary 11-Bit  
Programmable Counter  
DOPLL1 (3)  
Phase  
Detector  
Charge  
Pump  
FIN1# (6)  
19-Bit  
Latch  
Pwr-dwn  
PLL1  
OSC_IN (8)  
fr fp  
fr1  
fr2  
15-Bit  
Monitor  
Output  
Selector  
Reference Counter  
OSC_OUT (9)  
FO/LD (10)  
20-Bit Latch  
Latch  
Selector  
LE (13)  
DATA (12)  
20-Bit Latch  
Power  
Control  
15-Bit  
Reference Counter  
22-Bit  
Shift  
Cntrl  
Reg.  
CLOCK (11)  
19-Bit  
Latch  
Pwr-dwn  
PLL2  
Phase  
Detector  
Charge  
Pump  
F
IN2 (16)  
Prescaler  
64/65 or  
128/129  
Binary 4-Bit  
Swallow Counter  
Binary 11-Bit  
Programmable Counter  
DOPLL2 (18)  
fp2  
FIN2# (15)  
GND (14)  
GND (17)  
VP2 (19)  
Pin Configuration  
V
1
1
2
20  
19  
18  
17  
16  
15  
14  
13  
12  
11  
V
2
CC  
21  
20  
1
CC  
NC  
NC  
V 1  
V 2  
P
2
3
4
5
6
7
8
9
DoPLL2  
Vp1  
DoPLL1  
GND  
P
19  
18  
17  
16  
15  
14  
13  
GND  
Fin2  
Fin2#  
GND  
LE  
D PLL1  
3
D PLL2  
O
O
1
2
3
4
5
15  
14  
DoPLL1  
GND  
GND  
Fin2  
Fin2#  
GND  
LE  
GND  
4
GND  
(Top View)  
Fin1  
F
1
5
F
F
2
IN  
IN  
IN  
(Top View)  
13  
12  
11  
Fin1  
Fin1#  
GND  
F
1#  
6
2#  
Fin1#  
GND  
IN  
GND  
OSC_IN  
7
GND  
LE  
DATA  
NC  
OSC_IN  
NC  
8
OSC_OUT  
9
DATA  
CLOCK  
F /LD  
10  
O
CSP  
MLF  
TSSOP  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
February 6, 2001, rev. **  
1234567...12

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