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CY3672-USB PDF预览

CY3672-USB

更新时间： 2024-11-09 04:13:23
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 晶体时钟发生器微控制器和处理器外围集成电路光电二极管
页数 文件大小 规格书
8页 257K
描述
Very Low Jitter Field and Factory Programmable Clock Generator

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CY3672-USB 技术参数

生命周期：Obsolete零件包装代码：SOIC
包装说明：0.150 INCH, MS-012, SOIC-8针数：8
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8473.30.11.80风险等级：5.8
Is Samacsys：NJESD-30 代码：R-PDSO-G8
长度：4.889 mm端子数量：8
最大输出时钟频率：133 MHz封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE主时钟/晶体标称频率：133 MHz
认证状态：Not Qualified座面最大高度：1.727 mm
最大供电电压：3.45 V最小供电电压：3.13 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：3.8985 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：1

CY3672-USB 数据手册

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CY22180  
PRELIMINARY  
Very Low Jitter Field and Factory  
Programmable Clock Generator  
Benefits  
Features  
• Low period and cycle-to-cycle jitter  
— Typical pk-pk period jitter: 60 ps  
• InternalPLLgeneratesup to200 MHzoutput. Can generate  
custom frequencies from an external crystal or a driven  
source.  
• Wide output frequency range  
• In-house programming of samples and prototype quantities  
can be done using the CY3672-USB programmer and  
CY3619socketadapter. Productionquantitiesareavailable  
through Cypress’s value added distribution partners or by  
using third party programmers from BP Microsystems, HiLo  
Systems, and others.  
— Commercial temperature: 20–200 MHz  
— Industrial temperature: 20–166 MHz  
• Input frequency range  
— External crystal: 10–30 MHz fundamental crystal  
— External reference: 10–133 MHz clock  
• Integrated phase-locked loop (PLL)  
• Field programmable and factory programmed options  
• Programmable crystal load capacitor tuning array  
• 3.3V operation  
• Eliminates the need for expensive and difficult to use  
higher-order crystals.  
• Enables fine-tuning of output clock frequency by adjusting  
CLoad of the crystal. Eliminates the need for external CLoad  
capacitors.  
• Application compatibility in standard and low-power  
systems  
• Commercial and industrial temperature ranges  
• Power down or output enable function  
• Enables low-power state or output clocks to High-Z state.  
Logic Block Diagram  
Pin Configuration  
CY22180  
8-pin SOIC  
PLL  
6
1
OUTPUT  
DIVIDER  
XIN/CLKIN  
CXIN  
CLKOUT  
1
2
3
XIN/CLKIN  
VDD  
XOUT  
NC  
8
7
6
PROGRAMMABLE  
CONFIGURATION  
8
XOUT  
CXOUT  
5
PD#/OE  
CLKOUT  
REFOUT  
3
4
VSS  
REFOUT  
5
PD# or OE  
2
4
VDD  
VSS  
Cypress Semiconductor Corporation  
Document #: 001-15577 Rev. **  
•
198 Champion Court  
•
San Jose, CA 95134-1709  
•
408-943-2600  
Revised May 10, 2007  
12345678

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