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CY2XL13ZXI01T

更新时间： 2024-11-23 20:02:27

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
14页	427K
描述
Clock Generator, 125MHz, CMOS, PDSO8, TSSOP-8

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CY2XL13ZXI01T 技术参数

生命周期：	Active	包装说明：	TSSOP,
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.78
其他特性：	CAN ALSO OPERATE AT 3.3V SUPPLY	JESD-30 代码：	R-PDSO-G8
长度：	4.4 mm	端子数量：	8
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	125 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	主时钟/晶体标称频率：	25 MHz
座面最大高度：	1.1 mm	最大供电电压：	2.625 V
最小供电电压：	2.375 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
宽度：	3 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

CY2XL13ZXI01T 数据手册

CY2XL13

Low-Noise LVDS Clock Generator

Features

Functional Description

■ Output: One low-voltage differential signal (LVDS) output pair

■ Output frequency: 125 MHz

The CY2XL13 is

phase-locked loop (PLL)-based

high-performance clock generator that uses Cypress’s low-noise

voltage control oscillator (VCO) technology to achieve less than

1-ps typical RMS phase jitter. The CY2XL13 uses an external

crystal reference input to generate one LVDS output pair, which

can be asynchronously enabled/disabled with an OE pin. The

device operates at 3.3 V or 2.5 V.

■ Input: 25-MHz external crystal

■ RMS phase jitter:

❐ At 125 MHz (12 kHz to 20 MHz offset): 0.65 ps typical

■ Package: Pb-free 8-pin thin shrunk small outline package

(TSSOP)

■ Supply voltage: 3.3 V or 2.5 V

■ Temperature range: Commercial or industrial

Logic Block Diagram

XIN

CLK

External

Crystal

CRYSTAL

OSCILLATOR

LOW-NOISE

PLL

OUTPUT

DIVIDER

CLK#

XOUT

Cypress Semiconductor Corporation

Document Number: 001-63177 Rev. *A

•

198 Champion Court

•

San Jose, CA 95134-1709

•

408-943-2600

Revised September 10, 2013

12 3 4 5 6 7...14

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