CY2XP304BVC

更新时间： 2024-01-27 03:33:23

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赛普拉斯 - CYPRESS		时钟
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描述
High-Frequency Programmable PECL Clock Generation Module

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CY2XP304BVC 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	BGA	包装说明：	VFBGA,
针数：	36	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.84	JESD-30 代码：	R-PBGA-B36
JESD-609代码：	e1	长度：	8 mm
湿度敏感等级：	3	端子数量：	36
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	1500 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	VFBGA	封装形状：	RECTANGULAR
封装形式：	GRID ARRAY, VERY THIN PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	1500 MHz	认证状态：	Not Qualified
座面最大高度：	1 mm	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	TIN SILVER COPPER
端子形式：	BALL	端子节距：	0.75 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	40
宽度：	6 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER

CY2XP304BVC 数据手册

CY2XP304

High-Frequency Programmable PECL

Clock Generation Module

• HSTL inputs—HSTL-to-LVPECL level translation

Features

• 125- to 500-MHz output range for high-speed

• Period jitter peak-peak 125MHz(max.) = 55 ps

• Four low-skew LVPECL outputs

• Phase-locked loop (PLL) multiplier select

• Serially-configurable multiply ratios

applications

• High-speed PLL bypass mode to 1.5 GHz

• 36-VFBGA, 6 × 8 × 1 mm

• 3.3V operation

• Eight-bit feedback counter and six-bit reference

counter for high accuracy

Block Diagram

CLK0

PLL_MULT

CLK0B

CLK1

XIN

XTAL

CLK1B

PLL

OSCILLATOR

XOUT

CLK2

SER CLK

CLK2B

CLK3

SER DATA

INA

CLK3B

INAB

CLK_SEL

Pin Configuration

C Y2X P 3 0 4 3 6 V F B G A P IN C O N F IG U R AT IO N

T O P V IE W

C LK 0

C L K 3B

C L K 0B

C L K 2 B

C L K 3

C L K 1

C LK 2

C L K 1 B

V D D A

G N D

V D D A

G N D

Xo u t

T O P V IE W

S E R _ D

A TA

V D D B

V D D A

G N D

S E R _ C L

N C

V D D B

V D D A

G N D

Xin

G N D

C L K _ S E

P L L _M U L

V D D A

IN A B

V D D B

IN A

G N D

V D D B

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose, CA 95134

•

408-943-2600

Document #: 38-07589 Rev. *B

Revised July 28, 2004

12 3 4 5 6 7...11

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