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CDCLVD110

更新时间： 2024-02-28 23:18:10
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德州仪器 - TI 时钟驱动器
页数 文件大小 规格书
10页 138K
描述
PROGRAMMABLE LOW-VOLTAGE 1:10 LVDS CLOCK DRIVER

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CDCLVD110 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Not Recommended零件包装代码：QFP
包装说明：LQFP, QFP32,.35SQ,32针数：32
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：6 weeks
风险等级：5.45系列：110
输入调节：DIFFERENTIAL MUXJESD-30 代码：S-PQFP-G32
JESD-609代码：e4长度：7 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：1
功能数量：1反相输出次数：
端子数量：32实输出次数：10
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：LQFP封装等效代码：QFP32,.35SQ,32
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE
包装方法：TR峰值回流温度（摄氏度）：260
电源：2.5 V最大电源电流（ICC）：130 mA
Prop。Delay @ Nom-Sup：3 ns传播延迟（tpd）：3 ns
认证状态：Not Qualified座面最大高度：1.6 mm
子类别：Clock Driver最大供电电压 (Vsup)：2.625 V
最小供电电压 (Vsup)：2.375 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.8 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7 mm
最小 fmax：150 MHz

CDCLVD110 数据手册

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CDCLVD110  
PROGRAMMABLE LOW-VOLTAGE 1:10 LVDS CLOCK DRIVER  
SCAS684 – SEPTEMBER 2002  
TQFP PACKAGE  
(TOP VIEW)  
D
D
Low-Output Skew <30 ps (Typical) for  
Clock-Distribution applications  
Distributes One Differential Clock Input to  
10 LVDS Differential Clock Outputs  
D
V
range 2.5 V ±5%  
24 23 22 21 20 19 18 17  
CC  
25  
26  
27  
28  
29  
30  
31  
32  
16  
15  
14  
13  
12  
11  
10  
9
VSS  
Q2  
VDD  
Q7  
D
Typical Signaling Rate Capability of Up to  
1.1 GHz  
Q2  
Q7  
D
D
D
D
D
Configurable Register (SI/CK) Individually  
Enables Disables Outputs, Selectable  
CLK0, CLK0 or CLK1, CLK1 Inputs  
Q1  
Q8  
Q1  
Q8  
Q0  
Q9  
Full Rail-to-Rail Common-Mode Input  
Range  
Q0  
Q9  
VDD  
VSS  
Receiver Input Threshold ±100 mV  
1
2
3
4
5
6
7
8
Available in 32-Pin TQFP Package  
Fail-Safe I/O-Pins for V  
Down)  
= 0 V (Power  
DD  
description  
The CDCLVD110 clock driver distributes one pair of differential LVDS clock inputs (either CLK0 or CLK1) to 10  
pairs of differential clock outputs (Q0, Q9) with minimum skew for clock distribution. The CDCLVD110 is  
specifically designed for driving 50-Ω transmission lines.  
When the control enable is high (EN = 1), the 10 differential outputs are programmable in that each output can  
be individually enabled/disabled (3-stated) according to the first 10 bits loaded into the shift register. Once the  
shift register is loaded, the last bit selects either CLK0 or CLK1 as the clock input. However, when EN = 0, the  
outputs are not programmable and all outputs are enabled.  
The CDCLVD110 is characterized for operation from –40°C to 85°C.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2002, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...10

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型号 品牌 获取价格 描述 数据表
CDCLVD110A TI

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 		PROGRAMMABLE LOW-VOLTAGE 1:10 LVDS CLOCK DRIVER
CDCLVD110ARHB TI

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