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TMS320UC5409GGU-80

更新时间： 2024-10-27 15:54:51

品牌	Logo	应用领域
德州仪器 - TI		时钟外围集成电路
页数	文件大小	规格书
80页	1091K
描述
Digital Signal Processor 144-BGA MICROSTAR -40 to 100

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TMS320UC5409GGU-80 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	BGA	包装说明：	LFBGA, BGA144,13X13,32
针数：	144	Reach Compliance Code：	not_compliant
HTS代码：	8542.31.00.01	Factory Lead Time：	1 week
风险等级：	5.73	其他特性：	ALSO REQUIRES 3.3V SUPPLY
地址总线宽度：	23	桶式移位器：	YES
位大小：	16	边界扫描：	YES
最大时钟频率：	20 MHz	外部数据总线宽度：	16
格式：	FIXED POINT	内部总线架构：	MULTIPLE
JESD-30 代码：	S-PBGA-B144	JESD-609代码：	e0
长度：	12 mm	低功率模式：	YES
湿度敏感等级：	3	端子数量：	144
最高工作温度：	100 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFBGA
封装等效代码：	BGA144,13X13,32	封装形状：	SQUARE
封装形式：	GRID ARRAY, LOW PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	220
电源：	1.8,1.8/3.3 V	认证状态：	Not Qualified
RAM（字数）：	32768	座面最大高度：	1.4 mm
子类别：	Digital Signal Processors	最大供电电压：	1.98 V
最小供电电压：	1.71 V	标称供电电压：	1.8 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	BALL	端子节距：	0.8 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	12 mm	uPs/uCs/外围集成电路类型：	DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：	1

TMS320UC5409GGU-80 数据手册

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SPRS101E − APRIL 1999 − REVISED OCTOBER 2008

Advanced Multibus Architecture With Three

Separate 16-Bit Data Memory Buses and

One Program Memory Bus

Arithmetic Instructions With Parallel Store

and Parallel Load

Conditional Store Instructions

Fast Return From Interrupt

40-Bit Arithmetic Logic Unit (ALU),

Including a 40-Bit Barrel Shifter and Two

Independent 40-Bit Accumulators

On-Chip Peripherals

− Software-Programmable Wait-State

Generator and Programmable Bank

Switching

− On-Chip Phase-Locked Loop (PLL) Clock

Generator With Internal Oscillator or

External Clock Source

− Three Multichannel Buffered Serial Ports

(McBSPs)

− Enhanced 8-Bit Parallel Host-Port

Interface With 16-Bit Data/Addressing

− One 16-Bit Timer

17- × 17-Bit Parallel Multiplier Coupled to a

40-Bit Dedicated Adder for Non-Pipelined

Single-Cycle Multiply/Accumulate (MAC)

Operation

Compare, Select, and Store Unit (CSSU) for

the Add/Compare Selection of the Viterbi

Operator

Exponent Encoder to Compute an

Exponent Value of a 40-Bit Accumulator

Value in a Single Cycle

− Six-Channel Direct Memory Access

(DMA) Controller

Two Address Generators With Eight

Auxiliary Registers and Two Auxiliary

Power Consumption Control With IDLE1,

IDLE2, and IDLE3 Instructions With

Power-Down Modes

Data Bus With a Bus-Holder Feature

Extended Addressing Mode for 8M × 16-Bit

Maximum Addressable External Program

Space

CLKOUT Off Control to Disable CLKOUT

On-Chip Scan-Based Emulation Logic,

†

IEEE Std 1149.1 (JTAG) Boundary Scan

16K x 16-Bit On-Chip ROM

Logic

32K x 16-Bit Dual-Access On-Chip RAM

12.5-ns Single-Cycle Fixed-Point

Instruction Execution Time (80 MIPS)

Single-Instruction-Repeat and

Block-Repeat Operations for Program Code

1.8-V Core Power Supply

Block-Memory-Move Instructions for Better

Program and Data Management

1.8-V to 3.6-V I/O Power Supply Enables

Operation With a SIngle 1.8-V Supply or

With Dual Power Supplies

Instructions With a 32-Bit Long Word

Operand

Available in a 144-Pin Plastic Thin Quad

Flatpack (TQFP) (PGE Suffix) and a 144-Pin

Ball Grid Array (BGA) (GGU Suffix)

Instructions With Two- or Three-Operand

Reads

Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of

Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.

All trademarks are the property of their respective owners.

†

IEEE Standard 1149.1-1990 Standard-Test-Access Port and Boundary Scan Architecture.

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POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443

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