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MK9173-01CS08LF

更新时间： 2024-09-14 06:59:11

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艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
9页	304K
描述
PLL Based Clock Driver, 9173 Series, 2 True Output(s), 0 Inverted Output(s), CMOS, PDSO8, SOIC-8

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MK9173-01CS08LF 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOIC-8
针数：	8	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.84
系列：	9173	输入调节：	STANDARD
JESD-30 代码：	R-PDSO-G8	JESD-609代码：	e3
长度：	4.9 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	8
实输出次数：	2	最高工作温度：	70 °C
最低工作温度：		输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	1.75 mm	最大供电电压 (Vsup)：	5.25 V
最小供电电压 (Vsup)：	4.75 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	3.9 mm	最小 fmax：	75 MHz

MK9173-01CS08LF 数据手册

DATASHEET

VIDEO GENLOCK PLL

MK9173-01/-15

Description

Features

The MK9173-01/-15 provide the analog PLL circuit blocks

to implement a frequency multiplier. Because the device is

configured to use an external divider in the PLL clock

feedback path, a large divider can be used to result in a

large frequency multiplication ratio. This is useful when

using a low frequency input clock to generate a high

frequency output clock. The MK9173-01/-15 contains a

phase detector, charge pump, loop filter, and

• Phase-detector/VCO circuit block

• Ideal for genlock system

• Reference clock range 12 kHz to 1 MHz for full output

clock range

• Output clock range of 1.25 to 75 MHz (-01), and 0.625 to

37.5 MHz (-15). See “Allowable Input Frequency to

Output Frequency” table for conditions

voltage-controlled oscillator (VCO). The ICS674-01 can be

used as the external feedback divider.

• On-chip loop filter

• Single 5 V power supply

• Low power CMOS technology

• 8-pin SOIC package

A common application of the MK9173-01/-15 is the

implementation of a video genlock circuit. Because of this,

the MK9173-01/-15 inputs operate on the negative-going

clock edge.

• For new video genlock applications, please refer to the

ICS673-01, ICS1522 or ICS1523.

The MK9173-01/-15 is pin and function compatible to the

AV9173-01/15.

Block Diagram

IDT™ VIDEO GENLOCK PLL

MK9173-01/-15

REV C 12/21/06

12 3 4 5 6 7...9

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型号	品牌	获取价格	描述	数据表
MK9173-01CS08T	ICSI	获取价格	Video Genlock PLL
MK9173-15	ICSI	获取价格	Video Genlock PLL
MK9173-15CS08	ICSI	获取价格	Video Genlock PLL
MK9173-15CS08LFT	IDT	获取价格	PLL Based Clock Driver, 9173 Series, 2 True Output(s), 0 Inverted Output(s), CMOS, PDSO8,
MK9173-15CS08T	ICSI	获取价格	Video Genlock PLL
MK9-1A66B	MEDER	获取价格	Reed Sensor Incorporated into a Hirschmann Connector
MK9-1A66C	MEDER	获取价格	Reed Sensor Incorporated into a Hirschmann Connector
MK9-1A66D	MEDER	获取价格	Reed Sensor Incorporated into a Hirschmann Connector
MK9-1A66E	MEDER	获取价格	Reed Sensor Incorporated into a Hirschmann Connector
MK9-1A84B	MEDER	获取价格	Reed Sensor Incorporated into a Hirschmann Connector

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