5秒后页面跳转
捷配首页

Datasheet > 逻辑 > 时钟驱动器> MC100EL34DG
MC100EL34DG PDF预览

MC100EL34DG

更新时间： 2024-09-27 05:22:27
品牌 Logo 应用领域
安森美 - ONSEMI 时钟驱动器时钟发生器逻辑集成电路光电二极管PC
页数 文件大小 规格书
8页 133K
描述
5V ECL ±2, ±4, ±8 Clock Generation Chip

阅读下载

中文翻译

获取价格

MC100EL34DG 技术参数

是否无铅： 不含铅生命周期：Active
零件包装代码：SOIC包装说明：SOP, SOP16,.25
针数：16Reach Compliance Code：compliant
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：1.32Samacsys Confidence：3
Samacsys Status：ReleasedSamacsys PartID：237646
Samacsys Pin Count：16Samacsys Part Category：Integrated Circuit
Samacsys Package Category：Small Outline PackagesSamacsys Footprint Name：SO-16 CASE 751B-05 ISSUE J
Samacsys Released Date：2015-11-26 01:50:37Is Samacsys：N
其他特性：NECL MODE: VCC = 0V WITH VEE = -4.2V TO -5.7V系列：100EL
输入调节：DIFFERENTIALJESD-30 代码：R-PDSO-G16
JESD-609代码：e3长度：9.9 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：1
功能数量：1反相输出次数：
端子数量：16实输出次数：3
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
电源：-4.5 VProp。Delay @ Nom-Sup：1.21 ns
传播延迟（tpd）：1.2 ns认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.05 ns座面最大高度：1.75 mm
子类别：Clock Drivers最大供电电压 (Vsup)：5.7 V
最小供电电压 (Vsup)：4.2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：ECL
温度等级：INDUSTRIAL端子面层：Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：3.9 mm最小 fmax：1100 MHz
Base Number Matches：1

MC100EL34DG 数据手册

 浏览型号MC100EL34DG的Datasheet PDF文件第2页浏览型号MC100EL34DG的Datasheet PDF文件第3页浏览型号MC100EL34DG的Datasheet PDF文件第4页浏览型号MC100EL34DG的Datasheet PDF文件第5页浏览型号MC100EL34DG的Datasheet PDF文件第6页浏览型号MC100EL34DG的Datasheet PDF文件第7页 
MC10EL34, MC100EL34  
5VꢀECL ÷2, ÷4, ÷8 Clock  
Generation Chip  
Description  
The MC10/100EL34 is a low skew ÷2, ÷4, ÷8 clock generation chip  
designed explicitly for low skew clock generation applications. The  
internal dividers are synchronous to each other, therefore, the common  
http://onsemi.com  
output edges are all precisely aligned. The V pin, an internally  
BB  
generated voltage supply, is available to this device only. For  
single-ended input conditions, the unused differential input is  
16  
1
connected to V as a switching reference voltage. V may also  
BB  
BB  
rebias AC coupled inputs. When used, decouple V and V via a  
BB  
CC  
0.01 mF capacitor and limit current sourcing or sinking to 0.5 mA.  
When not used, V should be left open.  
BB  
SO−16  
D SUFFIX  
CASE 751B  
The common enable (EN) is synchronous so that the internal  
dividers will only be enabled/disabled when the internal clock is  
already in the LOW state. This avoids any chance of generating a runt  
clock pulse on the internal clock when the device is enabled/disabled  
as can happen with an asynchronous control. An internal runt pulse  
could lead to losing synchronization between the internal divider  
stages. The internal enable flip−flop is clocked on the falling edge of  
the input clock, therefore, all associated specification limits are  
referenced to the negative edge of the clock input.  
MARKING DIAGRAMS*  
16  
1
16  
10EL34G  
AWLYWW  
100EL34G  
AWLYWW  
Upon startup, the internal flip-flops will attain a random state; the  
master reset (MR) input allows for the synchronization of the internal  
dividers, as well as multiple EL34s in a system.  
1
A
= Assembly Location  
= Wafer Lot  
= Year  
= Work Week  
= Pb−Free Package  
The 100 Series contains temperature compensation.  
WL  
YY  
WW  
G
Features  
• 50 ps Output-to-Output Skew  
• Synchronous Enable/Disable  
• Master Reset for Synchronization  
• PECL Mode Operating Range:  
*For additional marking information, refer to  
Application Note AND8002/D.  
V
CC  
= 4.2 V to 5.7 V with V = 0 V  
EE  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 7 of this data sheet.  
• NECL Mode Operating Range:  
= 0 V with V = −4.2 V to −5.7 V  
V
CC  
EE  
• Internal Input 75 kW Pulldown Resistors on CLK(s), EN, and MR  
• Pb−Free Packages are Available*  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
November, 2006 − Rev. 10  
MC10EL34/D  
12345678

中文翻译

下载PDF

MC100EL34DG 替代型号

型号 品牌 替代类型 描述 数据表
MC100EL34DR2G ONSEMI

完全替代

 5V ECL ±2, ±4, ±8 Clock Generation Chip
MC10EL34DR2G ONSEMI

完全替代

 5V ECL ±2, ±4, ±8 Clock Generation Chip
MC10EL34DG ONSEMI

类似代替

 5V ECL ±2, ±4, ±8 Clock Generation Chip

与MC100EL34DG相关器件

型号 品牌 获取价格 描述 数据表
MC100EL34DR2 ONSEMI

获取价格

 		±2,±4,±8 Clock Generation Chip
MC100EL34DR2G ONSEMI

获取价格

 		5V ECL ±2, ±4, ±8 Clock Generation Chip
MC100EL35 ONSEMI

获取价格

 		JK Flip-Flop
MC100EL35D MOTOROLA

获取价格

 		JK Flip-Flop.
MC100EL35D ONSEMI

获取价格

 		5V ECL JK Flip-Flop
MC100EL35DG ONSEMI

获取价格

 		5V ECL JK Flip-Flop
MC100EL35DR2 ONSEMI

获取价格

 		5V ECL JK Flip-Flop
MC100EL35DR2G ONSEMI

获取价格

 		5V ECL JK Flip-Flop
MC100EL35DT ONSEMI

获取价格

 		5V ECL JK Flip-Flop
MC100EL35DTG ONSEMI

获取价格

 		5V ECL JK Flip-Flop

与MC100EL34DG相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证