MC100E150FN

更新时间： 2024-02-11 12:34:13

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安森美 - ONSEMI		锁存器
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描述
5V ECL 6-Bit D Latch

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MC100E150FN 技术参数

是否无铅：	含铅	生命周期：	Active
零件包装代码：	QLCC	包装说明：	LEAD FREE, PLASTIC, LCC-28
针数：	28	Reach Compliance Code：	unknown
风险等级：	5.72	Is Samacsys：	N
其他特性：	NECL MODE: VCC = 0V WITH VEE = -4.2V TO -5.7V	系列：	100E
JESD-30 代码：	S-PQCC-J28	JESD-609代码：	e3
长度：	11.505 mm	逻辑集成电路类型：	D LATCH
湿度敏感等级：	NOT SPECIFIED	位数：	6
功能数量：	1	端子数量：	28
最高工作温度：	85 °C	最低工作温度：
输出特性：	OPEN-EMITTER	输出极性：	COMPLEMENTARY
封装主体材料：	PLASTIC/EPOXY	封装代码：	QCCJ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	260	传播延迟（tpd）：	0.8 ns
认证状态：	COMMERCIAL	座面最大高度：	4.57 mm
最大供电电压 (Vsup)：	5.7 V	最小供电电压 (Vsup)：	4.2 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	ECL	温度等级：	OTHER
端子面层：	MATTE TIN	端子形式：	J BEND
端子节距：	1.27 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	40	触发器类型：	LOW LEVEL
宽度：	11.505 mm	最小 fmax：	900 MHz
Base Number Matches：	1

MC100E150FN 数据手册

MC10E150, MC100E150

5VꢀECL 6-Bit D Latch

Description

The MC10E/100E150 contains six D-type latches with differential

outputs. When both Latch Enables (LEN1, LEN2) are LOW, the latch

is transparent and input data transitions propagate through to the

output. A logic HIGH on either LEN1 or LEN2 (or both) latches the

data. The Master Reset (MR) overrides all other controls to set the Q

outputs low.

http://onsemi.com

The 100 Series contains temperature compensation.

Features

• 800 ps Max. Propagation Delay

• PECL Mode Operating Range: V = 4.2 V to 5.7 V

PLCC−28

FN SUFFIX

CASE 776

with V = 0 V

• NECL Mode Operating Range: V = 0 V

with V = −4.2 V to −5.7 V

• Internal Input 50 kW Pulldown Resistors

• ESD Protection: Human Body Model; > 2 kV,

Machine Model; > 200 V

MARKING DIAGRAM*

Charged Device Model; > 2 kV

• Meets or Exceeds JEDEC Standard EIA/JESD78 IC Latchup Test

• Moisture Sensitivity Level:

Pb = 1

MCxxxE150FNG

AWLYYWW

Pb−Free = 3

For Additional Information, see Application Note AND8003/D

• Flammability Rating: UL 94 V−0 @ 0.125 in,

Oxygen Index: 28 to 34

• Transistor Count = 173 devices

• Pb−Free Packages are Available*

xxx

= 10 or 100

= Assembly Location

= Wafer Lot

= Year

= Work Week

= Pb−Free Package

*For additional marking information, refer to

Application Note AND8002/D.

ORDERING INFORMATION

See detailed ordering and shipping information in the package

dimensions section on page 6 of this data sheet.

*For additional information on our Pb−Free strategy and soldering details, please

download the ON Semiconductor Soldering and Mounting Techniques

Reference Manual, SOLDERRM/D.

Semiconductor Components Industries, LLC, 2006

Publication Order Number:

December, 2006 − Rev. 10

MC10E150/D

12 3 4 5 6 7 8

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MC100E151FN	MOTOROLA	获取价格	6-BIT D REGISTER
MC100E151FNG	ONSEMI	获取价格	5V ECL 6-Bit D Register
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