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MC100E151

更新时间: 2024-02-05 01:13:55
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安森美 - ONSEMI /
页数 文件大小 规格书
4页 108K
描述
6-BIT D REGISTER

MC100E151 技术参数

是否无铅: 含铅生命周期:Active
零件包装代码:QLCC包装说明:LEAD FREE, PLASTIC, LCC-28
针数:28Reach Compliance Code:unknown
风险等级:5.7其他特性:NECL MODE: VCC = 0V WITH VEE = -4.2V TO -5.7V
系列:100EJESD-30 代码:S-PQCC-J28
JESD-609代码:e3长度:11.505 mm
逻辑集成电路类型:D FLIP-FLOP湿度敏感等级:NOT SPECIFIED
位数:6功能数量:1
端子数量:28最高工作温度:85 °C
最低工作温度:输出特性:OPEN-EMITTER
输出极性:COMPLEMENTARY封装主体材料:PLASTIC/EPOXY
封装代码:QCCJ封装形状:SQUARE
封装形式:CHIP CARRIER峰值回流温度(摄氏度):260
传播延迟(tpd):0.9 ns认证状态:COMMERCIAL
座面最大高度:4.57 mm最大供电电压 (Vsup):5.7 V
最小供电电压 (Vsup):4.2 V标称供电电压 (Vsup):5 V
表面贴装:YES技术:ECL
温度等级:OTHER端子面层:MATTE TIN
端子形式:J BEND端子节距:1.27 mm
端子位置:QUAD处于峰值回流温度下的最长时间:40
触发器类型:POSITIVE EDGE宽度:11.505 mm
最小 fmax:900 MHzBase Number Matches:1

MC100E151 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC10E/100E151 contains 6 D-type, edge-triggered, master-slave  
flip-flops with differential outputs. Data enters the master when both CLK1  
and CLK2 are LOW, and is transferred to the slave when CLK1 or CLK2  
(or both) go HIGH. The asynchronous Master Reset (MR) makes all Q  
outputs go LOW.  
1100MHz Min. Toggle Frequency  
Differential Outputs  
6-BIT D REGISTER  
Asynchronous Master Reset  
Dual Clocks  
Extended 100E V  
EE  
Range of – 4.2V to – 5.46V  
75kInput Pulldown Resistors  
LOGIC DIAGRAM  
Q
Q
D
D
D
D
D
0
0
0
R
R
R
R
R
R
Q
Q
D
D
D
FN SUFFIX  
PLASTIC PACKAGE  
CASE 776-02  
1
1
2
3
1
Q
Q
2
2
Q
Q
3
3
Pinout: 28-Lead PLCC (Top View)  
MR CLK2 CLK1  
NC  
V
Q
Q
CCO  
5
5
D
Q
Q
4
5
D
D
4
25  
24  
23  
22  
21  
20  
19  
D
Q
Q
V
26  
18  
17  
16  
15  
14  
13  
5
4
4
D
27  
28  
4
4
D
Q
Q
D
5
3
CC  
5
V
Q
1
2
EE  
3
3
2
2
D
Q
Q
Q
2
CLK1  
CLK2  
3
D
D
1
0
MR  
4
12  
PIN NAMES  
Pin  
Function  
5
6
7
8
9
10  
11  
D
– D  
Data Inputs  
0
5
NC  
V
Q
Q
Q
Q
V
CCO  
CCO  
0
0
1
1
CLK1, CLK2  
Clock Inputs  
Master Reset  
True Outputs  
Inverted Outputs  
MR  
* All V  
and V  
pins are tied together on the die.  
CC  
CCO  
Q
Q
– Q  
– Q  
0
0
5
5
12/93  
Motorola, Inc. 1996  
REV 2  

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