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M74HC4017M1R

更新时间： 2024-11-22 22:09:15

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意法半导体 - STMICROELECTRONICS		计数器触发器逻辑集成电路光电二极管输出元件
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描述
DECADE COUNTER/DIVIDER

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M74HC4017M1R 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP16,.25
针数：	16	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.38
其他特性：	JOHNSON COUNTER WITH 10 DECODED OUTPUTS; TCO OUTPUT; GATED CLOCK	计数方向：	UP
系列：	HC/UH	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e4	长度：	9.9 mm
负载电容（CL）：	50 pF	负载/预设输入：	NO
逻辑集成电路类型：	RING COUNTER	最大频率@ Nom-Sup：	20000000 Hz
最大I（ol）：	0.004 A	工作模式：	SYNCHRONOUS
湿度敏感等级：	3	位数：	10
功能数量：	1	端子数量：	16
最高工作温度：	125 °C	最低工作温度：	-55 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
电源：	2/6 V	传播延迟（tpd）：	295 ns
认证状态：	Not Qualified	座面最大高度：	1.75 mm
子类别：	Counters	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	4.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
触发器类型：	POSITIVE EDGE	宽度：	3.9 mm
最小 fmax：	20 MHz	Base Number Matches：	1

M74HC4017M1R 数据手册

M54HC4017

M74HC4017

DECADE COUNTER/DIVIDER

HIGH SPEED

t_PD= 21 ns (typ.) AT V_CC= 5V

LOW POWER DISSIPATION

I_CC= 4 µA (MAX.) AT T_A= 25 ^oC

HIGH NOISE IMMUNITY

V_NIH= V_NIL= 28 % V_CC(MIN.)

OUTPUT DRIVE CAPABILITY

10 LSTTL LOADS

SYMMETRICAL OUTPUT IMPEDANCE

|I_OH| = I_OL= 4 mA (MIN.)

BALANCED PROPAGATION DELAYS

t_PLH= t_PHL

WIDE OPERATING VOLTAGE RANGE

B1R

(Plastic Package)

F1R

(Ceramic Package)

M1R

(Micro Package)

C1R

(Chip Carrier)

V_CC(OPR) = 2 V TO 6 V

PIN AND FUNCTION COMPATIBLEWITH

4017B

ORDER CODES :

M54HC4017F1R

M74HC4017B1R

M74HC4017M1R

M74HC4017C1R

PIN CONNECTIONS (top view)

DESCRIPTION

The M54/74HC4017 is a high speed CMOS DE-

CADE COUNTER/DIVIDER fabricated in silicon

gate C2MOS technology. It has the same high

speed performance of LSTTL combined with true

CMOS low power consumption.

The M54/74HC4017 is a 5-stage Johnson counter

with 10 decoded outputs. Each of the decoded out-

puts is normally low and sequentially goes high on

the low to high transition ofthe clock input.Each out-

put stays high for one clock period of the 10 clock

period cycle. The CARRY output goes low to high

after OUTPUT 10 goes low, and can be used in con-

junction with the CLOCK ENABLE to cascade sev-

eral stages.

The CLOCK ENABLE input disables counting when

in the high state. A RESET input is also provided

which when taken high sets all the decoded outputs

low.

NC =

No Internal

Connection

October 1992

1/12

12 3 4 5 6 7...12

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