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M74HC4017TTR

更新时间： 2024-09-14 22:23:23
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 计数器触发器逻辑集成电路光电二极管输出元件
页数 文件大小 规格书
12页 376K
描述
DECADE COUNTER/DIVIDER

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M74HC4017TTR 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP, TSSOP16,.25针数：16
Reach Compliance Code：not_compliantHTS代码：8542.39.00.01
风险等级：5.28Is Samacsys：N
其他特性：JOHNSON COUNTER WITH 10 DECODED OUTPUTS; TCO OUTPUT; GATED CLOCK计数方向：UP
系列：HC/UHJESD-30 代码：R-PDSO-G16
JESD-609代码：e0长度：5 mm
负载电容（CL）：50 pF负载/预设输入：NO
逻辑集成电路类型：RING COUNTER最大频率@ Nom-Sup：20000000 Hz
最大I（ol）：0.004 A工作模式：SYNCHRONOUS
位数：10功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：NOT SPECIFIED
电源：2/6 V传播延迟（tpd）：295 ns
认证状态：Not Qualified座面最大高度：1.2 mm
子类别：Counters最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：4.5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：4.4 mm
最小 fmax：20 MHzBase Number Matches：1

M74HC4017TTR 数据手册

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M74HC4017  
DECADE COUNTER/DIVIDER  
■
■
■
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■
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■
HIGH SPEED :  
= 21 ns (TYP.) at V = 6V  
t
PD  
CC  
LOW POWER DISSIPATION:  
=4µA(MAX.) at T =25°C  
I
CC  
A
HIGH NOISE IMMUNITY:  
= V = 28 % V (MIN.)  
V
NIH  
NIL  
CC  
DIP  
SOP  
TSSOP  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 4mA (MIN)  
OH  
OL  
BALANCED PROPAGATION DELAYS:  
t
t
ORDER CODES  
PACKAGE  
PLH  
PHL  
WIDE OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 6V  
TUBE  
T & R  
V
CC  
DIP  
SOP  
M74HC4017B1R  
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 4017  
M74HC4017M1R M74HC4017RM13TR  
M74HC4017TTR  
TSSOP  
DESCRIPTION  
The M74HC4017 is an high speed CMOS  
DECADE COUNTER/DIVIDER fabricated with  
silicon gate C MOS technology.  
The M74HC4017 is a 5-stage Johnson counter  
with 10 decoded outputs. Each of the decoded  
outputs is normally low and sequentially goes high  
on the low to high transition of the clock input.  
Each output stays high for one clock period of the  
10 clock period cycle. The CARRY output goes  
low to high after OUTPUT 10 goes low, and can  
be used in conjunction with the CLOCK ENABLE  
(CKEN)to cascade several stages.  
The CLOCK ENABLE input disables counting  
when in the high state. A CLEAR (CLR) input is  
also provided which when taken high sets all the  
decoded outputs low.  
All inputs are equipped with protection circuits  
against static discharge and transient excess  
voltage.  
2
PIN CONNECTION AND IEC LOGIC SYMBOLS  
August 2001  
1/12  
1234567...12

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