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LMK04610RTQR

更新时间： 2024-11-25 11:13:31
品牌 Logo 应用领域
德州仪器 - TI 时钟
页数 文件大小 规格书
132页 2885K
描述
具有双 PLL 且符合 JESD204B 标准的超低噪声和低功耗时钟抖动消除器 | RTQ | 56 | -40 to 85

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LMK04610  
ZHCSG17B –JANUARY 2017–REVISED JULY 2019  
具有双环路 PLL 且符合 JESD204B 标准的 LMK04610 超低噪声和低功耗  
时钟抖动消除器  
1 特性  
•
•
•
–40ºC 至 +85ºC 工业环境温度  
支持 105ºC PCB 温度（在散热焊盘上测量）  
1
•
•
双环路 PLL 架构  
超低噪声（10kHz 至 20MHz）：  
LMK04610：8mm × 8mm VQFN-56 封装，间距为  
0.5mm  
–
–
–
1966.08MHz 频率下 48fs RMS 抖动  
983.04MHz 频率下 50fs RMS 抖动  
122.88MHz 频率下 61fs RMS 抖动  
2 应用  
•
LTE-BTS、小型蜂窝、远程射频单元 (RRU) 等无  
线基础设施  
•
•
122.88MHz 时具有 –165dBc/Hz 本底噪声  
JESD204B 支持  
•
•
•
数据转换器和集成收发器时钟  
网络、SONET/SDH、DSLAM  
测试和测量  
–
一次性、脉冲和连续 SYSREF  
•
10 个差动输出时钟（处于 8 个频率组中）  
–
介于 700mVpp 和 1600mVpp 之间的可编程输  
出摆幅  
3 说明  
–
–
–
–
–
每个输出对可配置为 SYSREF 时钟输出  
16 位通道分频器  
LMK0461x 器件系列具有业界性能最高且功耗最低的  
抖动清除器，支持 JESD204B 接口。  
最小 SYSREF 频率为 25kHz  
最大输出频率为 2GHz  
器件信息(1)  
器件型号  
LMK04610  
VCO 频率  
精密数字延迟，动态可调  
5870MHz 至 6175MHz  
–
数字延迟 (DDLY) ½ × 时钟分配路径频率  
（最大 2GHz）  
(1) 如需了解所有可用封装，请参阅数据表末尾的可订购产品附  
录。  
–
–
60ps 步长模拟延迟  
50% 占空比输出分配，1 至 65535  
（偶数和奇数）  
简化原理图  
OSCout  
Multiple —clean“  
clocks at different  
frequencies  
VCXO  
LMX2582  
Recovered  
—dirty“ clock or  
clean clock  
PLL+VCO  
•
2 个基准输入  
CLKin0  
–
–
–
输入丢失时采用保持模式  
Backup  
Reference  
Clock  
CLKout9  
CLKout10  
FPGA  
LMK04610  
CLKin1  
自动和手动切换模式  
信号损失 (LOS) 检测  
CLKout5 &  
CLKout6  
CLKout1 &  
CLKout2  
•
•
在 10 个有源输出下的典型功耗为 0.88W  
DAC  
ADC  
CLKout7 &  
CLKout8  
CLKout3 &  
CLKout4  
通常由 1.8V（输出、输入）和 3.3V 电源（数字、  
PLL1、PLL2_OSC、PLL2 内核）供电  
Copyright © 2017, Texas Instruments Incorporated  
•
•
完全集成的可编程环路滤波器  
PLL2  
–
–
–
PLL2 相位检测器频率高达 250MHz  
OSCin 倍频器  
集成式低噪声 VCO  
•
•
内部功率调节：优于 –80dBc PSRR（在 VDDO  
上）（对于 122.88MHz 差动输出）  
3 线制或 4 线制 SPI 接口（4 线制为默认设置）  
1
本文档旨在为方便起见，提供有关 TI 产品中文版本的信息，以确认产品的概要。 有关适用的官方英文版本的最新信息，请访问 www.ti.com，其内容始终优先。 TI 不保证翻译的准确  
性和有效性。 在实际设计之前，请务必参考最新版本的英文版本。  
English Data Sheet: SNAS699  
 
 
 
 
 
 
 
 
 
 
 
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LMK04610RTQT TI

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 		具有双 PLL 且符合 JESD204B 标准的超低噪声和低功耗时钟抖动消除器 | RTQ
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