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K3N4U1000D-DC120 PDF预览

K3N4U1000D-DC120

更新时间： 2024-11-18 19:31:27
品牌 Logo 应用领域
三星 - SAMSUNG 有原始数据的样本ROM光电二极管内存集成电路
页数 文件大小 规格书
3页 51K
描述
MASK ROM, 512KX16, 120ns, CMOS, PDIP42, 0.600 INCH, DIP-42

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K3N4U1000D-DC120 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP,
针数：42Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.32.00.71
风险等级：5.92最长访问时间：120 ns
备用内存宽度：8JESD-30 代码：R-PDIP-T42
长度：52.42 mm内存密度：8388608 bit
内存集成电路类型：MASK ROM内存宽度：16
功能数量：1端子数量：42
字数：524288 words字数代码：512000
工作模式：ASYNCHRONOUS最高工作温度：70 °C
最低工作温度：组织：512KX16
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装形状：RECTANGULAR封装形式：IN-LINE
并行/串行：PARALLEL峰值回流温度（摄氏度）：NOT SPECIFIED
认证状态：Not Qualified座面最大高度：5.08 mm
最大供电电压 (Vsup)：3.3 V最小供电电压 (Vsup)：2.7 V
标称供电电压 (Vsup)：3 V表面贴装：NO
技术：CMOS温度等级：COMMERCIAL
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：15.24 mmBase Number Matches：1

K3N4U1000D-DC120 数据手册

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K3N4V(U)1000D-D(G)C  
CMOS MASK ROM  
8M-Bit (1Mx8 /512Kx16) CMOS MASK ROM  
FEATURES  
GENERAL DESCRIPTION  
The K3N4V(U)1000D-D(G)C is a fully static mask programma-  
ble ROM fabricated using silicon gate CMOS process technol-  
ogy, and is organized either as 1,048,576 x 8 bit(byte mode) or  
as 524,288 x 16 bit(word mode) depending on BHE voltage  
level.(See mode selection table)  
· Switchable organization  
1,048,576 x 8(byte mode)  
524,288 x 16(word mode)  
· Fast access time :  
3.3V operation : 100ns(Max.)  
3.0V operation : 120ns(Max.)  
· Supply voltage : single +3.0V/ single +3.3V  
· Current consumption  
This device operates with 3.0V or 3.3V power supply, and all  
inputs and outputs are TTL compatible.  
Because of its asynchronous operation, it requires no external  
clock assuring extremely easy operation.  
Operating : 30mA(Max.)  
Standby : 30mA(Max.)  
It is suitable for use in program memory of microprocessor, and  
data memory, character generator.  
· Fully static operation  
· All inputs and outputs TTL compatible  
· Three state outputs  
The K3N4V(U)1000D-DC is packaged in a 42-DIP and the  
K3N4V(U)1000D-GC in a 44-SOP.  
· Package  
-. K3N4V(U)1000D-DC : 42-DIP-600  
-. K3N4V(U)1000D-GC : 44-SOP-600  
FUNCTIONAL BLOCK DIAGRAM  
PIN CONFIGURATION  
A18  
X
MEMORY CELL  
MATRIX  
BUFFERS  
AND  
.
.
.
.
.
.
.
.
(524,288x16/  
1,048,576x8)  
DECODER  
A18  
A17  
A7  
1
2
42 N.C  
N.C  
A18  
44 N.C  
1
2
A8  
41  
43  
42  
41  
40  
39  
38  
N.C  
A8  
3
40 A9  
A17  
A7  
3
A6  
4
A10  
39  
Y
4
A9  
SENSE AMP.  
A5  
5
38 A11  
37 A12  
A6  
A5  
A4  
A3  
5
BUFFERS  
AND  
A10  
A11  
A12  
A4  
6
6
DATA OUT  
BUFFERS  
A3  
7
36  
A13  
35 A14  
7
DECODER  
A0  
A2  
8
8
37 A13  
36 A14  
A1  
9
A-1  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
24  
23  
22  
A15  
A2  
A1  
9
A0  
10  
11  
A16  
10  
11  
12  
13  
A15  
35  
34  
33  
32  
.
.
.
CE  
BHE  
VSS  
Q15/A-1  
Q7  
A0  
A16  
DIP  
VSS 12  
SOP  
BHE  
VSS  
CE  
VSS  
CE  
OE  
Q0  
Q8  
13  
14  
15  
Q0/Q8  
Q7/Q15  
CONTROL  
LOGIC  
OE 14  
31 Q15/A-1  
30 Q7  
OE  
Q14  
Q6  
Q0  
Q8  
Q1  
Q9  
15  
16  
17  
18  
Q1 16  
Q9  
BHE  
Q14  
Q6  
29  
28  
27  
26  
25  
24  
23  
17  
Q2 18  
Q13  
Q5  
Pin Name  
A0 - A18  
Pin Function  
Address Inputs  
Q13  
Q5  
Q10  
Q3  
19  
20  
21  
Q12  
Q4  
Q2 19  
Q12  
Q4  
Q10 20  
Q11  
VCC  
Q0 - Q14  
Data Outputs  
Q3  
21  
22  
Q11  
VCC  
Output 15(Word mode)/  
LSB Address(Byte mode)  
Q15 /A-1  
K3N4V(U)1000D-DC  
BHE  
CE  
Word/Byte selection  
Chip Enable  
Output Enable  
Power  
K3N4V(U)1000D-GC  
OE  
VCC  
VSS  
N.C  
Ground  
No Connection  
123

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型号 品牌 获取价格 描述 数据表
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