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ICS843002BKI-72LFT

更新时间： 2024-11-02 21:19:19

品牌	Logo	应用领域
艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
18页	296K
描述
Clock Generator, 122.88MHz, 5 X 5 MM, 0.925 MM HEIGHT, ROHS COMPLIANT, MO-220VHHD, VFQFN-32

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ICS843002BKI-72LFT 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN,	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.76
JESD-30 代码：	S-XQCC-N32	JESD-609代码：	e3
长度：	5 mm	端子数量：	32
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	122.88 MHz	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	19.2 MHz	认证状态：	Not Qualified
座面最大高度：	1 mm	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	5 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

ICS843002BKI-72LFT 数据手册

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FEMTOCLOCKS™ VCXO BASED WCDMA

CLOCK GENERATOR/JITTER ATTENUATOR

ICS843002I-72

GENERAL DESCRIPTION

FEATURES

The ICS843002I-72 is

ICS

member of the

• Two differential LVPECL outputs

HiperClockS™ family of high performance clock

solutions from IDT. The ICS843002I-72 is a

PLL based synchronous clock generator that is

optimized for WCDMA channel card applications

• CLK input accepts the following input levels:

LVCMOS or LVTTL levels

HiPerClockS™

• Output frequency: 122.88MHz (typical)

where jitter attenuation and frequency translation is needed.

The device contains two internal PLL stages that are cascaded

in series. The first PLL stage uses a VCXO which is optimized

to provide reference clock jitter attenuation and to be jitter

tolerant, and to provide a stable reference clock for the second

PLL stage.The second PLL stage provides additional frequency

multiplication (x32), and it maintains low output jitter by using a

low phase noise FemtoClock™VCO. The device performance

and the PLL multiplication ratios are optimized to support

WCDMA applications. The VCXO requires the use of an

external, inexpensive pullable crystal. VCXO PLL uses external

passive loop filter components which are used to optimize the

PLL loop bandwidth and damping characteristics for the given

application.

• FemtoClock VCO frequency range: 490MHz - 680MHz

• RMS phase jitter @ 122.88MHz, using a 19.2MHz crystal

(1.875MHz to 10MHz): 0.49ps (typical)

• Deterministic jitter: 30fs (typical)

• Random jitter, RMS: 2.2ps (typical)

• Full 3.3V or mixed 3.3V core/2.5V output supply voltage

• -40°C to 85°C ambient operating temperature

• Available in lead-free (RoHS 6) package

The ICS843002I-72 can accept a single-ended input. LOCK_DT

reports the lock status of VCXO PLL loop. If the reference clock

input is lost, it will set LOCK_DT to logic LOW.

Typical ICS843002I-72 configuration in WCDMA Systems:

• 19.2MHz pullable crystal

• Input Reference clock frequency: 3.84MHz

• Output clock frequency: 122.88MHz

PIN ASSIGNMENT

32 31 30 29 28 27 26 25

LF1

LF0

ISET

V^CC

LOCK_DT

V^EE

VCC

VCCO

nQ1

VCC

VEE

CLK

V^EE

10 11 12 13 14 15 16

ICS843002I-72

32-Lead VFQFN

5mm x 5mm x 0.925 package body

K Package

Top View

IDT^™/ ICS^™WCDMA CLOCK GENERATOR/JITTER ATTENUATOR

ICS843002BKI-72 REV. A NOVEMBER 21, 2007

12 3 4 5 6 7...18

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型号	品牌	获取价格	描述	数据表
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ICS843002BY-31LF	IDT	获取价格	Clock Generator, 700MHz, PQFP64, 10 X 10 MM, 1 MM HEIGHT, ROHS COMPLIANT, MS-026ACD-HD, TQ
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ICS843002BY-31T	IDT	获取价格	PLL/Frequency Synthesis Circuit
ICS843002CY31	ICSI	获取价格	700MHZ FEMTOCLOCKS? VCXO BASED FREQUENCY TRANSLATOR AND JITTER ATTENUATOR
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