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ICS507M-01DSWLF

更新时间： 2024-11-01 14:51:19

品牌	Logo	应用领域
艾迪悌 - IDT		时钟外围集成电路晶体
页数	文件大小	规格书
7页	135K
描述
Clock Generator, 200MHz, DIE

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ICS507M-01DSWLF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	DIE
包装说明：	DIE	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.5	Is Samacsys：	N
JESD-30 代码：	X-XUUC-N	JESD-609代码：	e3
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	200 MHz	封装主体材料：	UNSPECIFIED
封装代码：	DIE	封装形状：	UNSPECIFIED
封装形式：	UNCASED CHIP	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	52 MHz	认证状态：	Not Qualified
最大供电电压：	5.5 V	最小供电电压：	3 V
标称供电电压：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	MATTE TIN	端子形式：	NO LEAD
端子位置：	UPPER	处于峰值回流温度下的最长时间：	30
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

ICS507M-01DSWLF 数据手册

ICS507-01

PECL CLOCK SYNTHESIZER

Description

Features

The ICS507-01 is an inexpensive, simple way to

generate a low jitter 155.52 MHz (or other high speed)

differential PECL clock output from a low frequency

crystal input. Using Phase-Locked-Loop (PLL)

techniques, the devices use a standard fundamental

mode crystal to produce output clocks up to 200 MHz.

• Packaged in 16 pin SOIC

• Available in Pb (lead) free package

• Input crystal frequency of 5 - 27 MHz

• Input clock frequency of 5 - 52 MHz

• Enable usage of common low-cost crystal

Stored in each chip’s ROM is the ability to generate a

selection of different multiples of the input reference

frequency, including an exact 155.52 MHz clock from

common crystals. For lowest jitter and phase noise on

a 155.52 MHz clock, a 19.44 MHz crystal and the x8

selection can be used.

• Differential PECL output clock frequencies up to 200

MHz

• Duty cycle of 49/51

• Operation voltage of 3.3 V or 5.0 V ( 5ꢀ)

• Ideal for SONET applications and oscillator

manufacturers

This product is intended for clock generation. It has low

output jitter (variation in the output period), but input to

output skew and jitter are not defined nor guaranteed.

• Available in die form

• Industrial temperature versions available

• ICS507-02 is no longer available

Block Diagram

VDD

1.1 kohm

RES

270 ohm

PECL

S0:1

62 ohm

Clock

Synthesis

and Control

Circuitry

VDD

X1/ICLK

Clock

Crystal or

62 ohm

Buffer/

Crystal

clock input

PECL

Oscillator

270 ohm

Output Enable

(both outputs)

GND

Output resistors shown are for unterminated lines. Refer to MAN09 for additional information.

MDS 507-01 I

Revision 041905

Integrated Circuit Systems, Inc. ● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com

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型号	品牌	获取价格	描述	数据表
ICS507M-01DWF	IDT	获取价格	Clock Generator, 200MHz, DIE
ICS507M-01I	ICSI	获取价格	PECL Clock Synthesizer
ICS507M-01I	IDT	获取价格	Clock Generator, 125MHz, CMOS, PDSO16, 0.150 INCH, SOIC-16
ICS507M-01ILF	IDT	获取价格	Clock Generator, 125MHz, PDSO16, 0.150 INCH, LEAD FREE, SOIC-16
ICS507M-01ILFT	IDT	获取价格	Clock Generator, 125MHz, PDSO16, 0.150 INCH, LEAD FREE, SOIC-16
ICS507M-01IT	ICSI	获取价格	PECL Clock Synthesizer
ICS507M-01IT	IDT	获取价格	Clock Generator, 125MHz, CMOS, PDSO16, 0.150 INCH, SOIC-16
ICS507M-01LFT	IDT	获取价格	Clock Generator, 200MHz, PDSO16, 0.150 INCH, LEAD FREE, SOIC-16
ICS507M-01T	ICSI	获取价格	PECL Clock Synthesizer
ICS507M-02I	ICSI	获取价格	PECL Clock Synthesizer

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