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ICS3757GLF

更新时间: 2024-11-14 20:03:39
品牌 Logo 应用领域
艾迪悌 - IDT 时钟光电二极管外围集成电路晶体
页数 文件大小 规格书
6页 134K
描述
Video Clock Generator, 74.25MHz, PDSO16, 0.173 INCH, ROHS COMPLIANT, TSSOP-16

ICS3757GLF 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Obsolete零件包装代码:TSSOP
包装说明:TSSOP,针数:16
Reach Compliance Code:compliantECCN代码:EAR99
HTS代码:8542.39.00.01风险等级:5.84
JESD-30 代码:R-PDSO-G16JESD-609代码:e3
长度:5 mm端子数量:16
最高工作温度:70 °C最低工作温度:
最大输出时钟频率:74.25 MHz封装主体材料:PLASTIC/EPOXY
封装代码:TSSOP封装形状:RECTANGULAR
封装形式:SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度(摄氏度):260
主时钟/晶体标称频率:28 MHz认证状态:Not Qualified
座面最大高度:1.2 mm最大供电电压:3.6 V
最小供电电压:3 V标称供电电压:3.3 V
表面贴装:YES技术:CMOS
温度等级:COMMERCIAL端子面层:Matte Tin (Sn)
端子形式:GULL WING端子节距:0.65 mm
端子位置:DUAL处于峰值回流温度下的最长时间:30
宽度:4.4 mmuPs/uCs/外围集成电路类型:CLOCK GENERATOR, VIDEO
Base Number Matches:1

ICS3757GLF 数据手册

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PRELIMINARY INFORMATION  
ICS3757  
High Performance VCXO plus Multiplier for HDTV  
Description  
Features  
The ICS3757 combines a low-noise VCXO and a PLL  
frequency multiplier to create a high frequency VCXO  
with the low phase noise required for driving  
high-speed SERDES in SMPTE 292M compliant  
applications.  
Packaged in 16-pin TSSOP  
3.3 V supply voltage  
27 MHz clock or crystal input provides flexibility  
Selectable 74.25 MHz or 74.175824 MHz output  
clock  
27 MHz reference clock output  
Low phase noise and jitter  
Compliant to SMPTE 292M jitter specification  
Block Diagram  
VDD  
VDDR VDDO  
X1  
Output  
Driver  
PLL  
Clock  
Synthesis  
and  
CLK  
27 MHz clock  
VCXO  
or crystal input  
X2  
Control  
Circuitry  
Optional crystal  
capacitors  
Output  
Driver  
REFCLK  
VIN  
5
OER  
S4:0  
MDS 3757 A  
1
Revision 030606  
Integrated Circuit Systems, Inc. 525 Race Street, San Jose, CA 95126 tel (408) 297-1201 www.icst.com  

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