HD74HC76FP-E

更新时间： 2024-01-17 11:39:03

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瑞萨 - RENESAS		触发器
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7页	100K
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HC/UH SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16, FP-16DA

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HD74HC76FP-E 技术参数

生命周期：	Transferred	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	16
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.68	其他特性：	MASTER SLAVE OPERATION
系列：	HC/UH	JESD-30 代码：	R-PDSO-G16
长度：	5 mm	逻辑集成电路类型：	J-K FLIP-FLOP
位数：	2	功能数量：	2
端子数量：	16	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出极性：	COMPLEMENTARY
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
传播延迟（tpd）：	38 ns	认证状态：	Not Qualified
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
触发器类型：	NEGATIVE EDGE	宽度：	4.4 mm
最小 fmax：	24 MHz

HD74HC76FP-E 数据手册

HD74HC76

Dual J-K Flip-Flops (with Preset and Clear)

REJ03D0551-0200

(Previous ADE-205-423)

Rev.2.00

Oct 06, 2005

Description

Each flip-flop has independent J, K, preset, clear, and clock inputs and Q and Q outputs. This device is edge sensitive

to the clock input and change state on the negative going transition of the clock pulse. Clear and preset are independent

of the clock and accomplished by a low logic level on the corresponding input.

Features

•

High Speed Operation: t_pd(Clock to Q) = 21 ns typ (C_L= 50 pF)

High Output Current: Fanout of 10 LSTTL Loads

Wide Operating Voltage: V_CC= 2 to 6 V

Low Input Current: 1 µA max

Low Quiescent Supply Current: I_CC(static) = 2 µA max (Ta = 25°C)

Ordering Information

Package Code

(Previous Code)

Package

Abbreviation

Taping Abbreviation

(Quantity)

Part Name

Package Type

DILP-16 pin

SOP-16 pin (JEITA)

PRDP0016AE-B

(DP-16FV)

HD74HC76P

—

PRSP0016DH-B

(FP-16DAV)

HD74HC76FPEL

EL (2,000 pcs/reel)

Note: Please consult the sales office for the above package availability.

Function Table

Inputs

Outputs

Preset

Clear

Clock

H^*1

No change

Toggle

No change

H :

L :

X :

High level

Low level

Irrelevant

Note: 1. Q and Q will remain High as long as Preset and Clear are Low, but Q and Q are unpredictable, if Preset and

Clear go High simultaneously.

Rev.2.00, Oct 06, 2005 page 1 of 6

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型号	品牌	获取价格	描述	数据表
HD74HC76FPEL	RENESAS	获取价格	Dual J-K Flip-Flops (with Preset and Clear)
HD74HC76FP-EL	RENESAS	获取价格	HC/UH SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16, FP
HD74HC76FP-EL	HITACHI	获取价格	J-K Flip-Flop, HC/UH Series, 2-Func, Negative Edge Triggered, 2-Bit, Complementary Output,
HD74HC76FPEL-E	RENESAS	获取价格	IC,FLIP-FLOP,DUAL,J/K TYPE,HC-CMOS,SOP,14PIN,PLASTIC
HD74HC76P	RENESAS	获取价格	Dual J-K Flip-Flops (with Preset and Clear)
HD74HC76P	HITACHI	获取价格	J-K Flip-Flop, HC/UH Series, 2-Func, Negative Edge Triggered, 2-Bit, Complementary Output,
HD74HC76P-E	RENESAS	获取价格	HC/UH SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDIP16, 6.
HD74HC76RP	HITACHI	获取价格	J-K Flip-Flop, HC/UH Series, 2-Func, Negative Edge Triggered, 2-Bit, Complementary Output,
HD74HC76RP-EL	HITACHI	获取价格	J-K Flip-Flop, HC/UH Series, 2-Func, Negative Edge Triggered, 2-Bit, Complementary Output,
HD74HC77	HITACHI	获取价格	4-bit Bistable Latch

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