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CY7C018-12AC

更新时间： 2024-09-16 22:06:11

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赛普拉斯 - CYPRESS		/
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19页	386K
描述
64K/128K x 8/9 Dual-Port Static RAM

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CY7C018-12AC 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	PLASTIC, TQFP-100
针数：	100	Reach Compliance Code：	not_compliant
ECCN代码：	3A991.B.2.B	HTS代码：	8542.32.00.41
风险等级：	5.92	最长访问时间：	12 ns
其他特性：	INTERRUPT FLAG; AUTOMATIC POWER-DOWN; SEMAPHORE	I/O 类型：	COMMON
JESD-30 代码：	S-PQFP-G100	JESD-609代码：	e0
长度：	14 mm	内存密度：	589824 bit
内存集成电路类型：	DUAL-PORT SRAM	内存宽度：	9
湿度敏感等级：	3	功能数量：	1
端口数量：	2	端子数量：	100
字数：	65536 words	字数代码：	64000
工作模式：	ASYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	64KX9
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装等效代码：	QFP100,.63SQ,20
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE, FINE PITCH
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	235
电源：	5 V	认证状态：	Not Qualified
座面最大高度：	1.6 mm	最大待机电流：	0.00025 A
最小待机电流：	4.5 V	子类别：	SRAMs
最大压摆率：	0.29 mA	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	14 mm	Base Number Matches：	1

CY7C018-12AC 数据手册

CY7C008/009

CY7C018/01964K/128K

x 8/9 Dual-Port Static RAM

CY7C008/009

CY7C018/019

64K/128K x 8/9 Dual-Port Static RAM

Features

• True Dual-Ported memory cells which allow simulta-

neous access of the same memory location

• Fully asynchronous operation

• Automatic power-down

• 64K x 8 organization (CY7C008)

• 128K x 8 organization (CY7C009)

• 64K x 9 organization (CY7C018)

• 128K x 9 organization (CY7C019)

• 0.35-micron CMOS for optimum speed/power

• High-speed access: 12^[1]/15/20 ns

• Low operating power

• Expandable data bus to 16/18 bits or more using Mas-

ter/Slave chip select when using more than one device

• On-chip arbitration logic

• Semaphores included to permit software handshaking

between ports

• INT flags for port-to-port communication

• Dual Chip Enables

• Pin select for Master or Slave

• Commercial and Industrial temperature ranges

• Available in 100-pin TQFP

— Active: I_CC= 180 mA (typical)

—Standby: I_SB3= 0.05 mA (typical)

Logic Block Diagram

R/W

[2]

8/9

I/O –I/O

7/8R

7/8L

I/O

Control

I/O

Control

16/17

[3]

A –A^[3]

–A

Address

Decode

Address

Decode

True Dual-Ported

15/16L

0R 15/16R

RAM Array

16/17

A –A^[3]

–A

[3]

15/16L

0R 15/16R

Interrupt

Semaphore

Arbitration

R/W

SEM

[4]

BUSY

INT

M/S

Notes:

1. See page 6 for Load Conditions.

2. I/O –I/O for x8 devices; I/O –I/O for x9 devices.

3. A –A for 64K devices; A –A for 128K.

4. BUSY is an output in master mode and an input in slave mode.

Cypress Semiconductor Corporation

Document #: 38-06041 Rev. *C

•

3901 North First Street

•

San Jose

•

CA 95134

•

408-943-2600

Revised June 22, 2004

12 3 4 5 6 7...19

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